关于SPI总线的时钟极性（CLKPolarity）和时钟相位（CLKPhase）以及时钟计算

最新推荐文章于 2025-06-25 09:07:18 发布
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分类专栏： stm32开发笔记 文章标签： HAL库的开发
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本文链接：https://blog.csdn.net/Mr_liu_666/article/details/84995212
本文深入解析SPI时钟极性和相位配置，通过实例说明时钟在高位和低位的变化，以及采样发生在第一个或第二个边沿的具体含义。同时，通过具体频率设置，解释了SPI时钟频率的计算方式。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

  hspi1.Init.CLKPolarity = SPI_POLARITY_HIGH;//时钟极性为高的时候，就是平时都是高电平
    //这里的high就是1，low就是0
  hspi1.Init.CLKPhase = SPI_PHASE_2EDGE;//1就是第一个时钟沿，2就是第二个时钟沿

有一些文章写得上升沿下降沿真的不如第一个边沿和第二个来的易懂

看第一张图，空闲时是高电平，第二个时钟沿采样

看第二张图，频率设置的是4MHz，64分频，那么就是62.5KHz的时钟，而事实上是125K的

SPI总线协议（集成电路间通信接口标准、SPI工作原理、时钟极性(CPOL)和时钟相位(CPHA)、SPI相关寄存器和HAL库驱动、NOR FLASH基于SPI接口基本驱动步骤）
扬帆起航
06-15 3765
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搜索微信公众号（airX嵌入式）获取更多知识
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《《《《《正文》》》》》 为什么单独拿这个来说，是因为这个很重要，往往只要告诉你是SPI，以及这个2个参数，你就要知道怎么写通信代码了！这样才是一个合格的spi程序员。 我们知道，SPI总线上的数据什么时候获取有效是根据CLK的变化沿来决定，但一次CLK变化沿是有2个时间点的，因此需要双方先规定选择哪个变化沿，包括CLK的起始电平，所以这个是非常重要的东西； SPI 的工作时序模式由 CPOL（Clock Polarity，时钟极性）和 CPHA（Clock Phase，时钟相位...
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文章来源：转来转去的不知道是谁的了。。 SPI由于接口相对简单（只需要4根线），用途算是比较广泛，主要应用在EEPROM，FLASH，实时时钟，AD转换器，还有数字信号处理器和数字信号解码器之间。即一个SPI的Master通过SPI与一个从设备，即上述的那些Flash，ADC等，进行通讯。而主从设备之间通过SPI进行通讯，首先要保证两者之间时钟SCLK要一致，互相要商量好了，要匹配，否则，就没法正常通讯了，即保证时序上的一致才可正常讯。而这里的SPI中的时钟和相位，指的就是SCLk时钟的特性，即保证主从设
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