FPGA实现中频信号去直流：原理详解与工程实践

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分类专栏： FPGA信号处理文章标签： fpga开发信号处理

于 2025-02-18 19:12:55 首次发布

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FPGA实现中频信号去直流：原理详解与工程实践

摘要

在无线通信和雷达系统中，中频信号常因硬件电路失调或混频器泄漏引入直流偏移。本文详细介绍基于FPGA的数字去直流算法原理，并提供可工程化的实现方案，包含MATLAB验证模型、Verilog核心代码及资源优化技巧。(文末提供源代码下载链接)

1.直流偏移的产生和影响

1.1 直流来源

模拟前端放大器失调电压
混频器本振泄漏（LO Leakage）
ADC量化误差累积

1.2 不良影响

降低ADC有效动态范围
导致后续解调出现星座图偏移
引起放大器饱和失真

图1 中频信号频谱示意图

2. 去直流核心算法原理

2.1 滑动均值滤波法

算法公式：
$_{est}[n]= \frac{1}{N} \sum_{k=u}^{N-1}{x[n-k]}$

$x_{out}=x[n] - DC_{est}[n]$

特性分析：

窗长N决定截止频率：
$f_c = \frac{fs}{2N}$
适用于平稳信号环境

2.2 一阶高通滤波法

差分方程：
$\alpha y[n-1] + (1- \alpha)(x[n]-x(n-1))$
（α值决定-3dB截止频率）

3. FPGA实现架构设计

3.1 系统级框图

3.2 模块功能说明

数据对齐缓冲：实现输入数据的流水线寄存
直流估计器：采用移位寄存器实现滑动窗口
动态截位模块：防止累加溢出

4. Verilog关键代码解析

4.1 滑动窗口累加器

module dc_estimator (
    input 				    clk, 
    input 				    rst,
    input signed [15:0]      din,     //输入的ADC原始数据
    output reg signed [15:0] dc_value //计算出的直流信号估计值
);

parameter WINDOW_SIZE = 1024; // 滑动窗口的大小
    
reg signed [31:0] accum = 0;  //窗口内所有数据的累加结果    
reg [15:0] buffer [0:WINDOW_SIZE-1];  
    
integer i;

always @(posedge clk) begin
    if(rst) begin 
        accum <= 0;
        for(i=0; i<WINDOW_SIZE; i=i+1)
            buffer[i] <= 0;
    end else begin
        // 累加运算，求窗口中所有数据的和
        accum <= accum + din - buffer[WINDOW_SIZE-1];
        // 移位寄存器更新，实现窗口滑动控制
        for(i=WINDOW_SIZE-1; i>0; i=i-1)
            buffer[i] <= buffer[i-1];
        buffer[0] <= din;
    end
end

// 均值计算（右移实现除法）
always @* begin
    dc_value = accum >> 10; // 1024=2^10
end

endmodule

4.2 动态位宽处理技巧

输入数据位宽：16bit
累加器位宽：16 + log2(N) → 32bit满足1024点累加
最终截断保留有效位

5. 仿真测试与结果分析

5.1 MATLAB验证模型

% 生成测试信号
fs = 100e6;
t = 0:1/fs:1e-3;
sig = 0.5*sin(2*pi*1e6*t) + 0.1; % 加入100mV直流偏移

% FPGA模型等效处理
window_size = 1024;
dc_est = movmean(sig, window_size);
sig_out = sig - dc_est;

% 结果可视化
subplot(211); plot(t, sig); title('原始信号');
subplot(212); plot(t, sig_out); title('去直流后信号');