基于verilog开发的巴克码

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本文探讨了巴克码在雷达和通信系统中的应用,详细介绍了基于Verilog的巴克码识别器仿真设计,包括PN序列发生器、时钟发生器和检测电路。巴克码因其理想的自相关特性在同步系统中广泛应用。文中还展示了Vivado 2019.2的仿真结果,并提供了MATLAB仿真源码。
摘要由CSDN通过智能技术生成

目录

1.算法概述

2.仿真效果

3.matlab仿真源码


1.算法概述

       现代雷达要求既能探测远距离目标,又要有高的距离分辨力。高的距离分辨力要求有极窄的脉冲宽度,这就限制了发射功率的增加 ,从而影响雷达的探测距离。采用脉冲压缩技术,发射宽脉冲信号,接收时经脉冲压缩后变成窄脉冲,可以解决雷达作用距离和距离分辨力之间的矛盾。脉冲压缩雷达的发射信号一般为调频信号和二相编码信号。在有限的二相编码序列中,巴克码序列为最佳序列,它具有理想的自相关特性,在PD 雷达中得到了广泛的应用。

       同步是通信系统中一个重要的实际问题。通信系统有效地、可靠地工作是建立在良好的同步系统基础上的。数字通信系统中帧同步一般采用集中插入同步法,而性能良好的巴克码是目前帧同步(群同步)系统中用得比较广泛的同步码,该码组具有尖锐的自相关函数,且在接收端进行同步识别时出现漏同步、伪同步的概率小,群同步平均建立时间短,同时接收端的同步码识别器较为简单[1]。本文主要阐述了如何利用SystemView实现巴克码识别器仿真。仿真系统主要由伪随机序列(Pseudo-Noise,PN)发生器、时钟发生器、8位移位寄存器、加法器及逻辑比较器组成。通过设计仿真电路,分析电路仿真结果,为最终硬件实现提供理论依据。

        巴克码识别系统由伪随机序列(数据

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