XILINX 时钟设置

以下缓冲器可用于 7 系列 FPGA 设计中的时钟:

  • BUFIO 
  • BUFR 
  • BUFMR 
  • BUFG/BUFGCTRL/BUFGMUX 
  • BUFH 

BUFIO 和 BUFR

BUFIO 和 BUFR 缓冲器可用于不需要访问器件所有区域的区域时钟。它们通常被用作 IOSERDES 接口设置的时钟。如果您需要了解有关如何使用这两个缓冲器之一的更多详情,则可以在 7 系列 FPGA 时钟资源用户指南 (UG472) 的“区域时钟资源”部分中找到这些信息: http://china.xilinx.com/support/documentation/user_guides/ug472_7Series_Clocking.pdf

BUFMR

BUFMR 是 7 系列器件的新增缓冲器。7 系列器件中的 BUFR 和 BUFIO 只能在其自己的时钟区域中本地布线。BUFMR 必须用于布线到邻近的时钟区域。BUFMR 只能使用 MRCC(具有多区域时钟功能)引脚进行驱动。如果您需要了解有关如何使用此缓冲器的更多详情,敬请参见 7 系列 FPGA 时钟资源用户指南 (UG472) 的“多区域时钟缓冲器”部分和附录 A: http://china.xilinx.com/support/documentation/user_guides/ug472_7Series_Clocking.pdf

BUFG、 BUFGCTRL、和 BUFGMUX

BUFG/BUFGCTRL/BUFGMUX 可用于驱动全局时钟,使该时钟可以到达整个器件的逻辑。您只能通过 CCIO(具有时钟功能的 IO)引脚访问 BUFG 缓冲器。如果您需要了解有关如何使用 BUFG 缓冲器的更多详情,敬请参见 7 系列 FPGA 时钟资源用户指南 (UG472) 的“全局时钟资源”部分: http://china.xilinx.com/support/documentation/user_guides/ug472_7Series_Clocking.pdf

BUFH

水平时钟缓冲器 (BUFH) 可驱动单个区域中的水平全局时钟树干。这些缓冲器包括可用于动态打开或关闭时钟网络的时钟启用功能。这样,您就可以关闭不在使用当中的逻辑区域,以此节约功耗。如欲了解有关如何使用 BUFH 缓冲器的更多详情,敬请参见 7 系列 FPGA 时钟资源用户指南 (UG472) 的“区域时钟资源”部分:http://china.xilinx.com/support/documentation/user_guides/ug472_7Series_Clocking.pdf

Xilinx时钟恢复是指在FPGA设计中使用Xilinx器件时,当时钟信号被干扰或丢失时,重新确保时钟信号的正确性和稳定性的过程。 时钟信号在FPGA设计中起着非常关键的作用,它是控制电路中各个模块操作顺序的基准。如果时钟信号丢失或被干扰,可能会导致整个设计出现问题,影响系统的正常工作。因此,时钟恢复对于保证设计的正常操作至关重要。 在Xilinx设计中,时钟恢复可以通过以下几个步骤实现: 1. 检测:首先需要检测时钟信号是否丢失或被干扰。可以通过在设计中引入时钟检测电路来进行检测,当检测到时钟信号异常时,系统可以采取相应措施。 2. 恢复:一旦检测到时钟信号异常,需要进行时钟恢复操作。恢复可以分为软件恢复和硬件恢复两种方式。软件恢复一般通过重新配置时钟模块或重新加载时钟约束来实现。硬件恢复一般通过引入备用的时钟源或冗余时钟电路来替代丢失或干扰的时钟信号。 3. 验证:恢复时钟后,需要验证恢复后的时钟信号的正确性和稳定性。可以通过时钟周期测量、时钟相位对齐等方法来进行验证,确保恢复后的时钟信号满足设计要求。 Xilinx时钟恢复是保障FPGA设计正确性的重要步骤之一,合理的时钟恢复方案可以避免由于时钟问题引发的系统故障,确保设计的稳定性和可靠性。在实际应用中,需要根据具体的设计需求和时钟特性来选择合适的时钟恢复策略,并进行适当的验证和优化。
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