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原创 Signal tap 的各种用法

;这次内容有点多,主要是方便我以后自己查看各个模式的含义,里面介绍的也是目前我最常用的。还有一些细节内容,想要详细了解的推荐查看手册,在公众号后台回复Signal Tap手册获取。

2023-02-01 16:53:11 105

原创 FPGA设计CPU书籍

提供一些使用FPGA搭建CPU处理器的书籍,需要的自取。

2023-01-02 13:50:53 181 3

原创 自制CPU

CPU是计算机的核心部件,提供一些介绍CPU原理和自制CPU的电子书。

2022-12-11 16:56:20 384 1

原创 国外数字书籍第2期

推荐几本中英文都有的电子书籍,需要的自取

2022-12-05 19:10:03 134 1

原创 FPGA书籍

提供几本关于数字设计及FPGA的中文电子书

2022-11-30 19:19:20 1480 1

原创 vscode搭建Verilog HDL开发环境

工欲善其事,必先利其器,利用vscode搭建快速高效的Verilog HDL开发平台。

2022-11-27 17:27:47 1565 8

原创 这道题你能得几分?

从一个简单的函数看出阅读源码的重要性,这个函数大多人都写过,如果这样评分能得几分?

2022-11-24 16:26:09 32

原创 FPGA数字信号、图像

提供几本FPGA数字信号和数字图像相关的电子书,需要的自取。

2022-11-21 12:30:06 394

原创 补码符号位的权重

补码的由来由于原码在进行编码时采用了数制与码制相结合的方法,即最高位符号位采用0代表正数,1代表负数的码制编码方式,低位采用带有相应权重的数制编码方式进行编码;而码制是不能进行算术运算的,这就会出现5的原码0_0101,加上-5的原码1_0101,等于1_1010而不是等于0;而且会出现正零0_0与负零1_0的表达方式,但实际并不存在正零和负零,造成编码的浪费;补码权重由于原码所存在的问题,就出现了补码,补码等于原码按位取反加一,补码采用数制编码方式进行编码,最高位(符号位)虽然依旧是0代表正数,1代

2022-11-07 19:35:40 1481

原创 推荐system Verilog相关书籍

System Verilog 在多数情况下被用于 IC 验证,相关书籍其实比较多,这里先提供绿皮书,红宝书,希望对大家有用。

2022-11-07 19:34:58 597 1

原创 VHDL优秀电子书籍分享

提供一些国外优秀电子书籍,需要的同学可以在在公众号进行下载

2022-10-12 21:39:40 327 3

原创 Cyclone IV代FPGA的可编程逻辑资源

通过一些实例讲解FPGA的LE能够完成的功能,对时序约束相关知识的理解很有帮助。

2022-09-29 22:58:24 280

原创 国外数字书籍推荐

推荐三本书籍,在学数电的强烈推荐前两本书籍,如果时间不够,推荐先看第二本,有兴趣的可以看看

2022-09-24 19:44:48 183

原创 推荐FPGA入门书籍

本次推荐了四本书,分别是夏宇闻老师的语法书,潘老师的至简设计法,以及FPGA结构与原理和高级技巧设计的书籍,前三本可以方便快速入门,最后一本建议有一定基础在进行阅读。后续还会推荐一些书籍以及电子书。

2022-09-10 12:43:50 1477

转载 从另一个角度看补码

根据原码的缺陷理解补码的编码规则,知道补码与原码本质区别,符号位编码方式的不同,从而得到补码符号位有权重,就可以用更简单的方式理解补码能表示的数据范围,以及补码对应位数能表示的最小值,有符号数位扩展的原理。

2022-09-06 15:17:18 76

转载 通过按键消抖讲解可综合for循环

通过按键消抖扩展讲解FOR循环的使用

2022-09-03 15:07:14 145

原创 详解SR锁存器不定态

转载于我的微信公众号:数字站,根据SR锁存器电路详细分析不定态出现的原因,画出时许波形图

2022-08-27 19:54:45 1929 1

原创 八段数码管动态显示(输入数据为BCD编码)

FPGA位选驱动任意个八段数码管显示的驱动代码,以两个计数器为主要架构,使用自动计算位宽函数,参数化设计,例化方便。

2022-08-15 13:50:10 3798 4

原创 FPGA时序分析工具(TimeQuest)

通过一个最简单的案例熟悉Time Quest进行时序约束的操作流程和原理

2022-03-02 16:38:32 1580 1

原创 FPGA内数据传输模型

根据D触发器的数据传输原理,对建立时间,数据传输延迟,D触发器延迟,时钟偏斜,数据传输时间,数据到达时间进行讲解,最后推出建立时间余量表达式以及数据需求时间,数据到达时间等

2022-03-02 16:08:21 483

原创 FPGA基本原理

FPGA基本内部结构原理讲解

2022-03-02 15:49:50 2540 2

原创 Verilog常用语法

Verilog可综合常用语法一、模块的结构、数据类型、变量和基本运算符号1 模块的结构1.1 端口定义module 模块名(口1,口2,口3,…);两种模块例化方式:方法一:模块名(连接端口1信号名,连接端口2信号名,连接端口3信号名,…);方法二:模块名(.端口名1(连接信号1名),.端口名2(连接信号2名),…);例化时还可以对模块中的参数型(parameter)变量进行重新赋值;例如:module min(input clk,input rst_n,input a1,outpu

2021-02-08 18:15:37 16408 1

原创 交通灯控制逻辑电路设计

交通灯控制逻辑电路设计这是一个数电实验,交通灯,如果使用FPGA或者单片机来完成的话,会简单很多,这里采用的是使用常规的计数器,触发器,门电路等基本器件搭建,扩展部分可以完成总通行时间在100s内任意设置,红、黄、绿灯亮的时间长短之和在100s内任意设置,其实想要超过100s只需要扩展相应的计数器,以及门电路即可,限制功能的往往是资源;一、选题背景1.1、应用背景为了确保十字路口的车辆顺利、畅通地通过,往往都采用自动控制的交通信号灯来进行指挥。其中红灯(R)亮表示该条道路禁止通行;黄灯(Y)亮表示停

2021-01-24 13:38:44 21197 22

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