【PCIE707】MPSOC(ZU9EG/ZU15EG)PCIE架构高性能数据预处理 FMC载板设计资料

板卡概述
PCIE707 是一款基于 PCIE 总线架构的高性能数据预处理 FMC载板,板卡具有 1 个 FMC+(HPC)接口,1 路 PCIe x4 主机接口、 1 个 RJ45 千兆以太网口、2 个 QSFP+ 40G 光纤接口。板卡采用 Xilinx 的高性能 UltraScale+ MPSOC 系列 FPGA 作为实时处理器,实现 FMC 接口数据的采集、处理、以及设备间互联传输。PS 端外挂 1 组 72 位 DDR4 SDRAM 大容量缓存,PS 端外挂 2 组 32 位的 DDR4 SDRAM 缓存。 该板卡通过搭载不同的 FMC 子卡,可快速搭建起基于服务器的 数据采集、实时处理、高性能存储平台。可以满足于网络通信、高速 数据交换存储、工业控制、深度学习、AI 智能、云计算、4K 视频传 输处理以及航空航天等应用。

软件支持
可选集成板级软件开发包(BSP):
PS 端底层接口驱动;
PL 端接口驱动以及底层开发;
可根据需求提供定制化算法与系统集成:
应用范围
视频图像处理;
软件无线电 SDR 平台;
人工智能
技术指标
板载 MPSOC 实时处理器:XCZU15EG-2FFVB1156I;
CPU 与 GPU 性能:
4x ARM Cortex-A53,1.333GHz;
双核 Cortex-R5,533MHz;
GPU:Mali-400 MP2;
PS 端接口与性能:
PS 端支持 5 片 DDR4 SDRAM,位宽 72 位,速率 2400Mbps;
PS 端支持 1 路 RJ45 千兆以太网口;
PS 端支持 1 路 PCIe gen2 x4@5Gbps/lane;
PS 端支持 1 片 8GB eMMC FLASH 作为系统大容量存储设备;
PS端支持2片512Mbit QSPI Flash作为FPGA用户数据存储;
PS 端支持 1 个 Mico SD 卡,支持 SD 和 SPI 模式;
PS 端支持 1 个 USB OTG 接口;
PS 端支持 1 路调试 RS232 串口;
PL 端接口与性能:
支持 2 组 32 位 DDR4 SDRAM,数据速率 2400Mbps;
标准 1 个 FMC+(HPC)接口,符合 VITA57.4 规范;
FMC+支持 x16 GTH@16Gbps/lane 高速串行总线;
FMC+支持 80 对 LVDS 信号;
支持 2 路 QSFP+光纤接口;
其它接口性能:
1 个标准 ATX +12V 供电插座;
板载 4 个 LED 指示灯,前面板 2 个 LED 指示灯;
支持 1 路 RS422 接口;
物理与电气特征
板卡尺寸:106 x 207mm;
板卡供电:5A max@+12V(±5%,不含给子卡供电);
散热方式:风冷散热;
工作温度:-20°~+60°C
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MPSoC(Multiprocessor System-on-Chip)是一种集成了多个处理器核心、内存和其他外设的芯片。而PCIe(Peripheral Component Interconnect Express)是一种高速串行总线接口标准,用于扩展计算机内部的连接。 当两个MPSoC之间进行PCIe通信时,通常涉及以下几个方面: 1. 连接设置:首先,需要通过PCIe接口将两个MPSoC进行物理连接。这通常需要使用适当的PCIe插槽或转接板来实现。插槽或转接板会提供适当的引脚和电信号以支持高速数据传输。 2. 驱动程序和协议:接下来,需要在每个MPSoC中配置适当的驱动程序和通信协议来支持PCIe通信。这些驱动程序和协议负责建立连接、管理数据传输和处理错误。 3. 数据传输:一旦建立了PCIe连接,两个MPSoC之间就可以开始进行数据传输。数据可以通过PCIe总线在MPSoC之间进行高速、双向的传输。这样,两个MPSoC就可以共享数据、执行远程操作或者进行协同计算。 4. 错误处理和容错:在进行PCIe通信过程中,可能发生传输错误或其他异常情况。需要在驱动程序和协议中实现适当的机制来处理这些错误,并保证数据的可靠性和完整性。 总体而言,两个MPSoC之间的PCIe通信提供了一种高效的方式来实现多处理器系统之间的数据传输和协同计算。这种通信方式可以在高速、低延迟的环境下支持大规模数据流,并为多种应用场景提供了一种灵活的解决方案。

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