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FPGA
Article about FPGA
Unknown_Fighter
这个作者很懒,什么都没留下…
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xilinx ila使用问题记录
在ila的实际使用过程中,出现了一个问题就是添加了这个ila后,将数据改变了,查看ila的ip生成界面发现input pipe stages为0,而输入的信号有些是非寄存器的信号,所以对于这种情况将input pipe stages设置为1比较好...原创 2021-09-08 14:26:22 · 869 阅读 · 0 评论 -
vivado仿真脚本生成
在做算法验证过程中,当需要验证的数据量特别大时,相信大部分开发者均不会再选择使用波形文件一个一个验证,那样几乎不可能完成任务,因此使用vivado生成仿真脚本,将激励生成和结果验证都写好使整个过程自动化就显得尤为重要。vivado提供了方便的仿真脚本生成,选择File-->Export-->Export Simulation,在打开的对话框中,目标仿真器选择vivado simulator,然后选择输出目录即可。使用脚本过程中,细心的朋友会发现仿真过程中会生成一个叫testbench.w原创 2021-07-02 15:23:57 · 1864 阅读 · 1 评论