数字电路设计之同步状态机的verilog HDL实现

最新推荐文章于 2022-11-12 23:28:27 发布
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分类专栏： Digital Chip Design 文章标签： verilog 同步状态机 注意点经验
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同步状态机的verilog HDL实现：1、状态编码：   二进制编码：比较简单，使用状态向量较少，但是状态间可能会有毛刺。   格雷码：减少了状态间的位变化，降低了功耗有减少了毛刺，但是不适用于很多状态的跳转实现。   独热编码：多少种状态就用多少位实现，当哪一位为1的时候说明处在哪一种状态。2、 HDL描述语言有多种，但是不同的描述电路性能大不相同。一般有3种描述方
摘要由CSDN通过智能技术生成

同步状态机的verilog HDL实现：

1、状态编码：

   二进制编码：比较简单，使用状态向量较少，但是状态间可能会有毛刺。

   格雷码：减少了状态间的位变化，降低了功耗有减少了毛刺，但是不适用于很多状态的跳转实现。

   独热编码：多少种状态就用多少位实现，当哪一位为1的时候说明处在哪一种状态。

2、 HDL

描述语言有多种，但是不同的描述电路性能大不相同。

一般有3种描述方法：单always，双always和三always块。

单always使用的是输出逻辑与下一状态逻辑都用reg

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Snail_Walker
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