cadence从原理图到pcb

完成原理图设计后,需要进行如下步骤才能开始画PCB:

  • 原理图规制检测(DRC)
  • 生成网表
  • 新建PCB文件,设置封装路径
  • 导入网表
  • 设置原点和栅格
  • 绘制PCB板框
  • 将器件导入PCB

原理图规制检测(DRC)

选中原理图文件,运行Tools->Design Rules Check

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-8RxOtayX-1687602861394)(./pic/1.png)]

进行电气规制检查

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-NbnEiHWQ-1687602861396)(./pic/2.png)]

勾选下面5个选项

在这里插入图片描述

生成网表

电气规制检查无误后生成网表,选中原理图,点击下图所示按钮。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-UZbkNOZt-1687602861397)(./pic/4.png)]

网表在allegro文件夹中

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-1TH1AjR5-1687602861398)(./pic/5.png)]

新建PCB文件,设置封装路径

打开PCB软件

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-wuORFk5W-1687602861399)(./pic/6.png)]

新建PCB文件,选择路径,设置PCB文件名称。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-W37V5EKR-1687602861399)(./pic/7.png)]

设置封装路径

Setup->User Preferences,设置padpath和psmpath。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-wEhJJZh8-1687602861399)(./pic/11.png)]

导入网表

选择File-> Import->Logic,

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-69eLT60J-1687602861400)(./pic/8.png)]

选择Design entry CIS,在Import directory中选择刚才生成网络的路径,然后点击Improt Cadence,将网表导入。

查看导入状态

Display->Status

在这里插入图片描述

设置原点和栅格

点击Setup-> Design Parameter,如下图所示:

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-ucDrDhT7-1687602861402)(./pic/12.png)]

绘制PCB板框

绘制20x20mm的边框。在右侧Option中选择如下图所示:

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-2v4uPz1l-1687602861402)(./pic/13.png)]

菜单中选择Add->Line,然后再命令窗口中输入:i

x 00 
iy 200 
ix 200
iy -200
ix -200

将器件导入PCB

菜单中选择Place->Quickplace,在出现对话框中选择place。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-AyXA2sdp-1687602861403)(./pic/14.png)]

导入完成后:

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-e0hAwBjY-1687602861403)(./pic/15.png)]

去除多余显示

器件导入后,显示非常混乱,需要做如下调整,打开Display->Color。

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-YaZoLEOe-1687602861403)(./pic/16.png)]

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-ijhaoVD3-1687602861404)(./pic/17.png)]

[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-tM5ivIZF-1687602861404)(./pic/18.png)]

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