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ModelSim仿真时测试模块端口无输出的一种情况
在使用ModelSim仿真的时候出现给了激励信号,模块端口却没有输出的一种情况。经排查是在测试激励文件(tb)里面没有给模块复位导致的。比如待测试模块(module)中有对reg型变量的操作,reg型变量是在复位信号下赋初始值的,因为在测试激励文件中,没有给复位信号或者一直使能会导致在使用ModelSim仿真时仿真软件不知道寄存器初始值的情况,因此与寄存器相关联的端口在仿真波形中没...原创 2018-07-25 20:29:48 · 6159 阅读 · 0 评论 -
Xilinx MIG DDR3 控制器 Modelsim 仿真
项目上用到图像拼接,输入的视频流要存DDR3,做个DDR3的Modelsim仿真。软件版本用的Vivado2017.3,这个版本生成的Modelsim仿真库好像跟Modelsim10.6版本才兼容。常用的Modelsim仿真库如下四个:secureip,unifast_ver,unimacro_ver,unisims_ver。 接着我上一篇转载的博客《Modelsi...原创 2018-11-21 17:06:31 · 3755 阅读 · 6 评论