106，Verilog-2005标准篇：仿真控制系统任务（Simulation control system tasks）

最新推荐文章于 2024-09-08 15:44:40 发布
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分类专栏： Verilog-2005标准详解篇 文章标签： fpga开发
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仿真控制系统有两个任务：

  1. $finish

  1. $stop

$finish系统任务只是让仿真器退出并将控制权传回主机操作系统。如果为该任务提供了一个表达式，那么其值（0、1 或 2）将决定在发出提示之前打印的诊断信息（见下表1）。如果没有提供参数，则默认值为 1。

表1：$finish系统任务诊断信息

$stop系统任务会使仿真暂停。该任务使用一个可选的表达式参数（0、1 或 2）来决定打印何种类型的诊断信息。诊断信息的输出量随传递给 $stop 的可选参数值的增加而增加。

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FPGA小飞
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