Xilinx FPGA功耗评估(笔记)

Xilinx Power Estimator
  • UG440 XPE(Xilinx Power Estimator)

  • 功耗包括静态功耗和动态功耗

    1. 动态功耗的动态部分(易操作)
    2. 动态功耗的静态部分
    3. 静态功耗,降低功耗,
    4. 电压和功耗关系
      P(staic) = V^3
      P(dynamic) = V^2
      
  • 静态功耗是三极管漏电流

    1. 静态功耗跟温度有关系
    2. 芯片规模下,静态功耗小
  • IO 功耗比较小,

  • BRAM消耗的功耗会比较大,

    1. no change 相对于write first 和read first模式功耗最低
    2. enable rate速率越小,功耗越小
    3. 可选择low power模式,分BRAM操作但是会多出译码逻辑,normal模式是并行同时操作BRAM
    4. BRAM块分的越小功耗越小,但是逻辑和布局会变大
  • GTH

    1. low power mode
    2. DFE mode
  • PS,大约2-4W(normal)

  • vivado 里面设置 Power optimition(不成熟), 对timing输出不好,功耗降低不大(0.9W)

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小梅哥在学习Xilinx FPGA期间进行了积极的探索,特别是对Cyclone V SOC的开发流程进行了学习。从裸机到基于Linux嵌入式系统,小梅哥实现了FPGA和ARM Cortex-A9 CPU之间的双向控制和数据传输。 在代码编写方面,小梅哥设计了一个名为mux2的模块,用于实现二选一多路器。模块包含了输入和输出端口,并通过assign语句实现了信号的赋值。 在激励文件中,小梅哥使用reg和wire定义了输入和输出信号,并通过mux2模块进行了实例化。然后,通过initial块生成了一系列的激励信号,对模块进行仿真。 总结来说,小梅哥在Xilinx FPGA学习笔记中记录了自己对Cyclone V SOC的学习、代码编写和激励文件的使用。这些学习内容对于理解FPGA开发流程以及实现特定功能非常有帮助。<span class="em">1</span><span class="em">2</span><span class="em">3</span> #### 引用[.reference_title] - *1* [FPGA自学笔记——设计与验证VIP版.pdf](https://download.csdn.net/download/qq_30307853/11656682)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 50%"] - *2* *3* [小梅哥Xilinx FPGA学习笔记1——二选一多路器](https://blog.csdn.net/weixin_42454243/article/details/122026484)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 50%"] [ .reference_list ]

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