Serdes系列总结——Xilinx serdes IP使用（一）——3G serdes

最新推荐文章于 2024-08-15 13:36:02 发布
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分类专栏： SERDES 文章标签： fpga
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本文档详述了在Xilinx Zynq 7035 FPGA上配置和使用3.072G速率、20bit I/O的3G Serdes IP过程。内容涵盖IP核设置、时钟和管脚配置，以及从仿真到上板调试的步骤。在IP核详细设置中，涉及GT Selection、Line Rate、Encoding和Clocking等选项。在IP example设计中，介绍了如何修改数据接口和避坑技巧，包括对gtwizard_0_GT_USRCLK_SOURCE.v文件的修改。最终，提供了一个经过修改的工程示例，可用于上板调试，并展示了成功的仿真结果。
摘要由CSDN通过智能技术生成

Serdes系列总结——Xilinx serdes IP使用（一）——3G serdes

器件：Xilinx zynq 7035
版本:vivado2019.2
实现：一个线速率为3.072G的，输入为20bit，输出为20bit的无协议无编码的4对serdes例程，参考时钟为153.6MHz
目的：记录从仿真到上板调试的过程，方便回忆

IP核的详细设置

第一个选项卡 GT Selection
在这里插入图片描述在这里插入图片描述
第二个选项卡 GT Line Rate,RefClk Selection
在这里插入图片描述
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