错误记录 - [Synth 8-2543] port connections cannot be mixed ordered and named

最新推荐文章于 2024-04-27 09:23:14 发布
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分类专栏： FPGA 文章标签： Verilog FPGA Vivado Synth 8-2543
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错误记录  - [Synth 8-2543] port connections cannot be mixed ordered and named 

错误原因：最后一个端口括号后还有逗号（，）。

ModuleTest ModuleTest_Test
(
    .Port1 (Port1),
    .Port2 (Port2),
    .Port3 (Port3),
);

Port3 是最后一个端口，括号后不加“，”。

ModuleTest ModuleTest_Test
(
    .Port1 (Port1),
    .Port2 (Port2),
    .Port3 (Port3)     //.Port3	(Port3),  -> .Port3	(Port3)
);

 

江幺
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