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RSS订阅原创 HLS报错之：Export RTL报错 “ERROR: [IMPL 213-28] Failed to generate IP.“
HLS export RTL报错
2024-08-29 18:24:50
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原创 五、一个quad同时支持pcie和sfp两种高速接口的ref时钟配置
其中pc上位机与fpga之间通过pcie接口相连，axi_read模块读出的数据通过aurora8b10b模块实现并转串输出到光纤接口。本次项目是在XDMA框架下的桌面采集和PCIE传输项目以及aurora8b10b ip的使用（framing接口下的数据回环测试）两个项目的基础上进行的。本章内容：搭建适合pcie和sfp共用一个QUAD的框架本章重点：实现在a7板子上使用一个QUAD实现两种高速接口(pcie、sfp)框架的搭建。需要先了解：高速收发器的原理分析：本次项目中XDMA和aurora
2024-08-04 21:36:03
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原创 四、aurora8b10b ip的使用（framing接口下的数据回环测试）
Aurora 协议是一个用于在点对点串行链路间移动数据的可扩展轻量级链路层协议（由Xilinx开发提供）。这为物理层提供透明接口，让专有协议或业界标准协议上层能方便地使用高速收发器。Aurora协议在Xilinx的FPGA上有两种实现方式：8B/10B 与 64B/10B。两个协议大部分相同，主要区别在编码方式上：高速接口的IO都在MGT bank上面1个bank有4对Lane，2对差分时钟。总结：1、ref_clk 的值根据对应硬件设计的来； 2、INIT CLK 和DRP CLK可
2024-08-01 21:56:51
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转载 ZYNQ资源介绍
在上一篇文章中（）对 ZYNQ 进行了简单的叙述，在做相关的内容之前，有必要对其具体内容进行详细的了解；首先是对这款芯片所包含的内容进行简单的了解（参考 UG585 手册）
2024-07-18 15:36:37
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原创 以太网协议介绍——UDP
Q：已经有 IP 协议了，为什么还需要 UDP 协议呢？A：事实上数据是可以直接封装在 IP 协议里而不使用 TCP、UDP 或者其它上层协议的。然而在网络传输中同一IP服务器需要提供各种不同的服务，各种不同的服务类型是使用端口号来区分的，例如用于浏览网页服务的 80 端口，用于FTP（文件传输协议）服务的 21 端口等。TCP和 UDP 都使用两个字节的端口号，理论上可以表示的范围为0~65535，足够满足各种不同的服务类型。Q：为什么选择的是 UDP 而不是传输更可靠的 TCP 呢？
2024-07-04 21:26:38
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原创 FPGA基本资源介绍
可编程输入/ 输出单元简称I/O 单元，是芯片与外界电路的接口部分，完成不同电气特性下对输入/ 输出信号的驱动与匹配要求。FPGA 的IOB 被划分为若干个组(bank)，每个bank 的接口标准由其接口电压VCCO 决定，一个bank 只能有一种VCCO，但不同bank 的VCCO 可以不同。只有相同电气标准的端口才能连接在一起，VCCO 电压相同是接口标准的基本条件。
2024-07-01 11:38:34
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原创 一、手写一个uart协议——rs232
上位机由串口助手通过 rx 线往 FPGA 发 8 比特数据，当 FPGA接收到 8 比特数据后，再通过 tx 线把接收到的 8 比特数据给上位机发回去，要求上位机接收到的数据和上位机发送的数据一样，并且保证连续发送也没问题。
2024-04-30 21:14:40
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原创 三、fpga对完成过滤和校验的有效包数据进行有效像素提取、MATLAB对数据源进行处理与下发（完整实现pc机→显示器通信链路）
上篇文章实现了MATLAB模拟发送UDP以太网协议数据包到fpga，能实现双沿数据→单沿数据转换，并将转换后的数据进行包过滤和crc校验，本篇内容要实现真正的从pc机下发视频数据，经过千兆以太网传输存储到fpga 的ddr3中，然后通过hdmi读出到显示屏上。
2024-04-18 14:23:44
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原创 五、RIFFA框架下的桌面采集和 PCIE 传输项目
任务描述：PC端先发送图片的配置包信息，然后上位机启动截屏APP应用程序，将截屏数据下发给FPGA，FPGA收到一帧的图像数据后会返回给上位机一个ACK信号，标志着上衣帧数据接收完毕，可以接收下一帧数据。DDR3实现fpga数据的缓存，HDMI完成DDR3图像的读取与显示。Frame_ack 要求在每接收完成一帧图像给上位机发送一次 frame_ack 帧数据，Frame_ack 帧数据是 8 个 DW 长度的 32’h55555555,用于通知上位机可以发送下一帧数据,保证有序的发送图像帧数据。
2024-03-18 14:11:45
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空空如也
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