allegro使用技巧

最新推荐文章于 2024-08-08 14:48:14 发布

m0_46626423

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文章标签： c语言

本文链接：https://blog.csdn.net/m0_46626423/article/details/134661008

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环境变量文件有两个，它们分别在系统盘的根目录下的pcbevn 目录中（比如系统在C 盘，那么evn 文件将在c:/pcbevn 下）和程序安装路径下（如Cadence 设计系统程序安装在D:/Cadence 下，则evn 文件将在D:/Cadence/PSD_15.1/share/pcb/text 目录下），前者是本地变量文件，后者是全局变量文件（系统自动建立，即为默认设置）。在本地变量文件中，主要存放的用户参数设置值（Setup->User Preferences..如库文件所在的路径等）。在全局变量文件中主要描述的是：应用程序的工作路径和系统的快捷键定义等等。在启动一个应用程序时，应用程序会根据环境变量中的参数进行初始化。

将xxxx_dxf 通过Edit-->Change转化为Outline，该方法前提只需要再复制一份dxf层闭合边框然后再change 否则只有一份cahnge之后dxf层的边框就没了
也可以通过z-copy方式将闭合的dxf层边框复制移动到对应outline层

assign color
shape add
Z-Copy(outline下的copy shape 和zcopy的界面一样的或者在edit- zcopy) 命令绘制Route_Keepin/Route_Keepout等层的各种类图形先把不封闭的线段闭合用 shape--compose shape命令将分段合成闭合shape
z-copy 设置keepin很方便

然后用z-copy options种设置class 为route keepin ，subclass为all ，size 勾选内缩conttract活外扩expand。单位mm。routekeepin代表区域内部是有效，
外部是无效，routekeepout是区域内无效，外部有效。
z copy可以不同类的层之间复制shape

铺铜后如何编辑边界：shape –> edit boundary 就可以对铜皮就行修改边界

copy

对不规则板框outline处理将不连续线段连成封闭的板框outline
shape---compose shape 右键 temp group 点选板框outline 一段段的右键 complete ，在option操作时 board geometry outline

反标原理图：http://bbs.ntpcb.com/read-htm-tid-153684.html
重新编号，便于装配。在原理图设计时时按照原理图中的位置进行编号的，但是这样在PCB中编号就是乱的。这就需要在PCB中重新编号，然后再反标注到原理图，步骤：Logic –> Auto Rename Refdes –> rename –> more 可以设置重新编号的选项选择preserve current prefixes即保持当前的编号前缀。
在原理图中进行反标注：打开原理图工程文件 –> tools –> back annotate –> 选择PCB Editor –> 确定即可
\

DRC 实心显示 setup-->user preferences...勾选Display中的display_drcfill.

关掉记忆上次改线宽的出线宽度，重新按约束出现，就是改动后线宽值不在其它信号线保持！
edit--user preferences editor --route里--勾选acon_on_width_override_retian

批量剪断走线的方法
manuafacture-- drafing-- delete by rectangle --右键option 勾选clines --选中对象走线高亮后再绘制矩形框--然后多组走线即可被剪断

对网络的显示操作：
1 飞线的关闭打开 display-- show/blank rats --option 点选component/net 可以对具体的器件和网络进行打开飞线或关闭飞线
1.1 也可以通过constraint设置： editor--net properties--constraint -properties中找到对应地或者电源网络==选中右侧具体的网络ojects--no rat列进行设置 on/off 该方式即使在rats all 后也不会显示出飞线来
2 对网络或器件赋颜色 display--assign color

走线是否记忆线宽的设置：setup - user preference - route - connect - acon_no_width_override_retain.

4.13 对电源引脚和地脚指定，并用不同颜色标注。点击Logic->Identify DC Nets。

在原理图和pcb editor交互过程中最好每页制作为一个group也可以方便后期整体操作观察。。。 -edit -- group

temp group 是比如在多选不同类目标后组成临时组移动方便，也可以框选或者单击多选，然后移动命令结束后这个临时group就消失打散了

多组线同时出现
https://blog.csdn.net/qq_41038655/article/details/103883490

拉线是伴随的飞线跟随线头
setup--Design Parameter Editor，然后在Ratsnest geometry点击下拉选择Straight

Cadence Allegro如何复用设计参数？
https://blog.51cto.com/u_15324234/3293639

Blank Rats 关闭所有飞线
unrats net #关掉网络飞线
Show Rats 打开所有飞线
rats net #打开网络飞线
Shape Edit Boundary #切割铜皮
shape select #修改铜皮
add line #添加没有电气属性的线
change #改变属性换层操作相同class 不同subclass切换

color #定义颜色
groupedit #群组编辑
slide #修改走线命令
add circle #画圆（非电气属性，非连接线）
add line #画线（非电气属性，非连接线）
add text #添加字符
"shape add;class Etch;subclass Top"
#添加shape
shape void polygon
#shape开窗,manual void/cavity(洞，腔，空心的)
shape edit boundary
#编辑shape边界
shape merge shapes
#shape合并
compose shape
#组成shape
compose shape
#组成shape
compose shape
#组成shape
compose shape
#组成shape
compose shape
#组成shape