UVM基本名次解释,帮助设计人员降低与设计人员的沟通成本

本文介绍了UVM的基本组件,包括uvm_object和uvm_component,以及它们的派生类,如uvm_sequence、uvm_driver、uvm_monitor等。此外,还讲解了UVM中的相位机制、配置数据库、TLM通信、sequence和寄存器模型。Factory机制和field_automation、config_db等辅助工具也进行了概述。
摘要由CSDN通过智能技术生成
  1. uvm_object是UVM中最基本的类,uvm_component也派生自uvm_object。
  2. 验证平台中常用派生自uvm_object的类有:
    a) uvm_sequence_item,trasaction就是从uvm_sequence_item派生的封装了一定信息的类;
    b) uvm_sequence,就是sequence_item的组合,sequence会直接与sequencer打交道,当driver向sequencer索要数据时,sequencer会检查是否有sequence要发送数据,当有sequence_item待发送时,会将此sequence_item交给driver;
    c) config,主要功能是规范验证平台的行为方式,如driver读取总校要持续几个时钟
    d) uvm_reg_item;uvm_reg_map;uvm_mem等用于register model
    e) uvm_phase,主要作用为控制uvm_component的行为方式,使得uvm_component平滑地在各个phase之间依次运转
  3. uvm_component比uvm_object多的两大特性为:通过new的时候制定parent参数来形成一种树形的组织结构;phase自动执行的特点。常用派生自uvm_component的类:
    a) Uvm_driver:driver的功能是向sequencer索要sequence_item(trasaction),并将sequence_item中的信息驱动到DUT上;
    b) Uvm_monitor:monitor做的事情与driver相反,从DUT的pin上接收数据,并转换成transaction级别的sequence_item,在把转换之后
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