【Zynq】Zynq SPI驱动中发送阶段的一图梳理

已于 2024-02-04 14:37:47 修改
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文章标签： linux 嵌入式硬件
于 2024-02-04 14:36:12 首次发布
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本文链接：https://blog.csdn.net/qq_32006213/article/details/136025629
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本文讨论了在ZynqMPSoc平台上的SPI0驱动中遇到的过早中断问题，导致CS脚提前拉高引发通信失败。作者尝试通过修改`spi_cadence.c`文件的`cdsn_spi_chipselect`函数来解决，虽然解决了单个设备连接问题，但限制了总线的设备数量。
摘要由CSDN通过智能技术生成

在这里插入图片描述

是的，你没看错，这篇博客就只有一个图。
另外如果有大佬能帮我解决SPI驱动层中断给的过早，导致CS脚提前拉高导致通信失败的问题，楼主将不胜感激，平台是ZynqMPSoc，使用的是SPI0，目前为了解决这个问题已经修改spi_cadence.c的cdsn_spi_chipselect函数为无论enable 是true 还是 false都将CS拉低。但这样一来，这个SPI总线就只能挂载一个设备了(虽然总共也就只能挂三个)

DantePayne
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