dds ip核的理解

最新推荐文章于 2024-02-01 08:00:00 发布
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文章标签： 单片机 stm32 fpga开发
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DDS是频率合成技术，其核心思想还是对主时钟利用一个大计数器进行分频。
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配置相位宽度是26，即26位分频计数器；主时钟是50MHz，那么每一份的时钟频率是(50*10^6) / (2^26)=0.745Hz，即每步进一步，频率增加0.745Hz。
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基于FPGA的DDS IP核设计
01-31
以Altera公司的Quartus Ⅱ 7.2作为开发工具，研究了基于FPGA的DDS IP核设计，并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件，结合32位嵌入式CPU软核Nios II，构成可编程片上系统（SOPC），利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片内完成，利用 SOPC技术，在一片 FPGA 芯片上实现了整个信号源的硬件开发平台，达到既简化电路设计、又提高系统稳定性和可靠性的目的。
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