【遇到的代码报错与解决办法】

最新推荐文章于 2024-08-14 08:41:11 发布
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分类专栏： IC设计/验证、FPGA
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Verilog HDL 数据类型 赋值错误 always块 assign
关键词由CSDN通过智能技术生成

错误1

Error (10137): Verilog HDL Procedural Assignment error at freq_test.v(36): object “dataoutf” on left-hand side of assignment must have a variable data type

原因：数据类型定义错误 或者 赋值类型错误

解决方法： 在always 过程块中被赋值的变量必须是 reg （寄存器型），用 assign 连续赋值的对象 必须定义成 wire（线型）；

注：assign应与always并行。

参考文献：1

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