数字信号处理基础----PLL(2)

最新推荐文章于 2024-05-04 14:15:04 发布

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分类专栏：数字信号处理基础文章标签： PLL

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1.PLL的特征和参数

关于PLL的锁定，有几种不同的说法，有说只要生成的信号的频率跟输入的信号的频率相同那么就代码PLL已经锁定;也有说法是生成的信号必须与参考输入同频同相才算锁定住。那就都行都可以，从一个FPGA的角度看来，那肯定是同频同相才算锁住，毕竟PLL IP核就是这种的。
PLL的设计主要需要考虑的几个参数有：

环路滤波器当中的三个增益：K1,K2,K3
鉴相器增益：K_p
NCO 增益:K_o

PLL的特性取决于这这几个参数,如果这几个参数设计不正确,那么PLL很可能锁定不了。
PLL的几个关键的特征参数如下:

达到锁定的时间
稳态误差
瞬态行为和跟踪能力
带宽

1.1 各项参数的意义

1.1.1 达到锁定的时间

输出信号达到和输入参考信号稳定的时间是一个很重要的参考指标，达到锁定状态的时间越短，在通信的同步中所需要的时间也就越短，这样需要的同步码也就越少，可以用来传输更多的信息。
影响锁定时间的因数有很多，比如达到滤波器当中增益的设置，VCO的初始静态频率等等。
下面是同样的一个PLL，当要生成的信号和初始静态频率偏差不同的时候，达到稳态的时间也是不同的，当输入的参考频率和静态初始频率相差较大的时候，达到稳态的时间也就越长。
在这里插入图片描述

1.1.2 稳态误差

即使PLL已经完成锁定了, PLL依然会存在一个稳态误差。稳态误差取决于环路滤波器的类型和输入信号的类型，一般来说，环路滤波器的阶数越高，那么能够锁定的信号也就更多，如下图所示。
这三种输入信号的类型分别是：

相位不同，相位误差有一个阶跃函数的变化
频率不同，相位误差的变化率保持固定
频率不同且在变化，误差的变化率也在增长
可以看到，不同阶数的PLL的锁定能力是不同的。阶数越高的PLL的锁定能力也就越强,在一般情况下,一个2阶PLL能够完成很多的同步任务了。

1.2.3 带宽

带宽涉及到PLL运行的频率范围，也设计到可以进入到PLL的噪声的频率范围。
PLL的带宽越大，那么可以锁定的频率范围也就越大，同时也就允许更多的噪声进入PLL，也会导致生成的信号的质量不好。
PLL的带宽越小，那么达到锁定的时间也就更长，但是其生成的信号质量更好，在期望频率上下的浮动范围更小。
如下图所示：
在这里插入图片描述

1.2.4 瞬态行为和跟踪能力

瞬态行为和跟踪能力取决于三个因素:

PLL 的类型,PLL的类型决定了输出是否能够稳定以及是否会产生稳态误差等
PLL的带宽，带宽越小，达到锁定所需要的时间也就越长
PLL的阻尼系数，阻尼系数影响了过冲和速度，阻尼系数一般取 $1/\sqrt(2)$ 或者1

2. PLL的设计

PLL的设计，按理来说，不简单，不过像我这种半吊子搬运工，那还不是直接把现成的拿来用。套用公式就够了。

2.1 采样周期的确定

在设计一个PLL之前，采样率一般是确定的，根据这个采样率可以确定PLL的采样周期。
在这里插入图片描述

如果系统的采样率没有确定,那么在确定系统采样率的时候,最好是期望生成正弦波频率的5倍。这是因为,使用基于乘法器的鉴相器,会产生一个2倍频率的高频分量,这时候以过采样的方式能够保持信号的完整。

2.2 鉴相器增益

对于理想的鉴相器和基于乘法器的鉴相器,两则所需要的增益是不同的,鉴相器的增益如下: 在这里插入图片描述
对于理想的鉴相器其增益为1,对于基于乘法器的鉴相器其增益为输入信号的振幅的1/2。
上面的式子说明了,基于乘法器的鉴相器的增益和输入信号的振幅有关,这种依赖关系是不好的,因为输入信号的变化会使PLL的行为发生变化。因此最好能将输入信号经过一个AGC,动态地来调整输入信号地增益,将其归一化到 -1~1。

2.3 NCO增益

NCO可以产生正弦和余弦信号频率可变,使用环路滤波器的输出来改变信号的频率。NCO的增益一般选择 1。

2.4 阻尼系数

阻尼系数在0.5~2这个范围内都有较好的锁定能力。阻尼系数是PLL的一个内部属性,在设计PLL之前就需要确定。

2.5决定噪声带宽

PLL的带宽是一个很重要的参数。比较窄的带宽能够允许更少的噪声信号进入,与此同时需要更多的时间来进行锁定。带宽比较宽的信号能够更快地完成锁定,但是抗噪声性能不好。因此在设计的时候,PLL的带宽是一个很重要的参数。
指定PLL的噪声带宽 $B_n$ 时,需要考虑输入的正弦载波信号和本地生成的正弦信号的频率差。
和阻尼系数 $\xi$ 类似, $B_n$ 也是PLL的一个内部属性,需要在设计PLL之前就确定下来。