共阴极的七段显示译码器的代码

最新推荐文章于 2024-04-22 21:32:34 发布
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分类专栏： 嵌入式学习 文章标签： FPGA
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版权 
module cy4(input LE,BL,LT,//输入端口声明
           input D3,D2,D1,D0,//输入端口声明
           output reg a,b,c,d,e,f,g//输出端口及变量的数据类型声明
           );
always @(*)
begin
  if(LT == 1) {a,b,c,d,e,f,g} = 7'b111_1111;//让显示器的7段都发光,显示8
  else if(BL == 1) {a,b,c,d,e,f,g} = 7'b000_0000;//让显示器的7段都熄灭,显示0
  else if(LE == 1) {a,b,c,d,e,f,g} = {a,b,c,d,e,f,g};//锁存显示
  else
    case({D3,D2,D1,D0})//根据输入的8421BCD码,实现显示译码器的功能
    4'd0: {a,b,c,d,e,f,g} <= 7'b111_1110;
    4'd1: {a,b,c,d,e,f,g} <= 7'b011_0000;
    4'd2: {a,b,c,d,e,f,g} <= 7'b110_1101;
    4'd3: {a,b,c,d,e,f,g} <= 7'b111_1001;
    4'd4: {a,b,c,d,e,f,g} <= 7'b011_0011;
    4'd5: {a,b,c,d,e,f,g} <= 7'b101_1011;
    4'd6: {a,b,c,d,e,f,g} <= 7'b001_1111;
    4'd7: {a,b,c,d,e,f,g} <= 7'b111_0000;
    4'd8: {a,b,c,d,e,f,g} <= 7'b111_1111;
    4'd9: {a,b,c,d,e,f,g} <= 7'b111_1011;
    default: {a,b,c,d,e,f,g} <= 7'b000_0000;//非8421BCD码输入时,不显示
    endcase
end
endmodule
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专栏目录
Verilog HDL BCD七段译码器
11-16
Verilog HDL 组合逻辑电路的设计——BCD七段译码器
【无标题】
m0_74785130的博客
11-06 60
数码管就是一种常见用于显示的器件,比如电子时钟中的显示时间的就是数码管,工业控制设备上数据显示，参数的显示等，在消费类电子上也有广泛的应用。其实数码管的本质就是发光二极管的组合使用。
实验3 7段数码管译码器动态显示
最新发布
qq_64919823的博客
04-22 1131
动态显示：LED数码管动态显示是最为广泛的一种显示方式之一，动态驱动是将所有数码管的8个显示笔划"a,b,c,d,e,f,g,dp"的同名端连在一起，另外为每个数码管的公共极COM增加位选通控制电路，位选通由各自独立的I/O线控制，当FPGA输出字形码时，FPGA对位选通COM端电路的控制，所以我们只要将需要显示的数码管的选通控制打开，该位就显示出字形，没有选通的数码管就不会亮。常用LED数码管显示的数字和字符是0、1、2、3、4、5、6、7、8、9（A、B、C、D、E、F、G）。核心代码如图3.4所示。
Verilog实现二位十进制数字的显示
江月的博客
11-22 7369
Verilog实现二位十进制数字的显示 文章目录Verilog实现二位十进制数字的显示一、简介二、代码三、效果展示 一、简介 我们这里使用Verilog来实现二位十进制数字的显示。 二、代码 /* 这个是显示数字的模块，用了两个数码管来显示00-59的60个数字 */ module number(seg_data_1,seg_data_2,seg_led_1,seg_led_2); input [3:0] seg_data_1; //数码管需要显示0~9十个数字，所以最少需要4位输入
【Multisim仿真】利用74LS48七段译码器和共阴极七段数码管进行译码显示实验
weixin_56661223的博客
11-07 1万+
【multisim仿真】利用74LS48七段译码器和共阴极七段数码管进行译码显示实验
【51单片机】七段数码管显示实验+详细讲解
cumtLeibnizDavid的博客
04-21 3万+
【51单片机】七段数码管显示实验前言一、兵马未动，粮草先行——认识七段数码管1、关于显示器2、七段数码管3、七段数码管的结构4、数码管显示方法二、数码管显示程序1.引入库2.读入数据总结前言一、pandas是什么？二、使用步骤1.引入库2.读入数据总结前言一、pandas是什么？二、使用步骤1.引入库2.读入数据总结 前言 继上次仿真实验——【51单片机】矩阵键盘线反转法实验仿真之后，尽管也对点阵LED进行了学习，但是，点阵LED的显示效果不佳（仿真时的色彩、明亮程度等），加上大多数时候我们在计算器上看到
Python turtle绘图——七段数码管显示数字和字母
Corone的博客
07-17 8236
七段数码管由7条线组成，以下图所标识的画图顺序为准进行程序设计。首先导入turtle库并将其重命名为t。定义函数drawGap()用于绘制间隙，通过将画笔抬起，并向前移动5个单位，来实现间隙的绘制。定义函数drawLine(draw)用于绘制线段，通过判断参数draw的布尔值，决定是否下笔绘制线段。如果布尔值为True，则将画笔放下，向前移动40个单位；如果布尔值为False，则将画笔抬起，向前移动40个单位。然后调用drawGap()函数绘制间隙，并将画笔右转90度，准备绘制下一段线。
【组合逻辑电路】——显示译码器
RL2698853114的博客
07-19 9665
共阴极接法中各个发光二极管的负极相连，a~g中，接高电平的线段发光，控制各引脚的电平高低，可显示0~9不同的数字图形。共阳极接法中，各发光二极管的正极相连，a~g中，接低电平的线段发光，控制各引脚的电平高低，可显示0~9不同的数字图形。7个发光二极管分别用a，b，c，d，e，f，g这7个小写英文字母表示。显示译码器随显示器件的类型而异，常用的半导体数码管、液晶数码管、荧光数码管等是由7个或8个字段构成字形的，因而与之相配的有BCD七段或BCD八段显示译码器。二、集成显示译码器74LS48。.........
数电实验——七段译码器源代码（VHDL）
01-06
数电实验——七段译码器源代码（VHDL）
译码器及其应用指导书
08-17
例如，CC4511（BCD 码锁存／七段译码／驱动器）驱动共阴极 LED 数码管。 CC4511 的引脚排列图如下所示，其中 A、B、C、D — BCD 码输入端；a、b、c、d、e、f、g — 译码输出端，输出“1”有效，用来驱动共阴极 LED ...
七段数码管动态显示电路设计1
08-03
【七段数码管动态显示电路设计】是一种常见的电子系统设计技术，主要应用于数字显示设备，如计算器、仪表盘等。本设计重点在于理解和应用8位七段数码管的动态显示控制，以及使用VHDL进行FPGA开发。 1. **七段数码管...
EDA七段数码显示译码器
11-29
EDA 实验 七段数码显示译码器代码 verilog
实训七 计数、译码、显示电路 用十进制计数器、译码器、显示器组成一个十进制计数显示电路
12-20
74LS48 是一种 BCD—七段译码器/驱动器，可以将二进制代码转换为七段码，并驱动共阴极的发光二极管显示器。其内部电路为集电极开路输出，可以直接与共阴式 LED 显示器相连接。 三、显示器的逻辑功能和应用 显示器...
VHDL 七段显示译码器
初学者
07-11 1万+
使用Quartus Ⅱ，器件为MAXⅡ——EPM240T100C5 七段显示译码器VHDL语言的代码如下： LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; Entity seg7_4 is --工程名为seg7_4 PORT ( BCD_in : IN STD_LOGIC_VECTOR(3 DOWNTO 0); --输入四位BCD码 SG_out : OUT STD_LOGIC_VECTOR(6 DOWNTO
显示译码器——Verilog HDL语言
MMagicLoren的博客
06-01 8924
显示译码器任务描述相关知识逻辑原理共阴数码管及其电路编程要求源代码 任务描述 根据所学的组合逻辑及数字电路的知识完成一个16进制7段数码显示译码器的设计，验证满足一个16进制7段数码显示译码器的规则，根据逻辑真值表和逻辑表达式完成表决功能。熟悉Quartus II的Verilog HDL文本设计流程，掌握组合逻辑电路的设计仿真和硬件测试的方法。最后完善一个16进制7段数码显示译码器电路的功能描述风格Verilog HDL 代码。 相关知识 逻辑原理 7 段数码是纯组合电路，通常的小规模专用 IC，如 74
c语言实现7段数码管显示,FPGA入门--七段数码管显示
weixin_33484805的博客
05-21 6855
原标题：FPGA入门--七段数码管显示本教程将教给大家如何使用北邮版FPGA开发板上的2个七段数码管。 七段数码管是电子设计中常用的一种LED显示器，可以显示数字0-9，以及一些其他符号，七段数码管根据内部发光二极管的连接方式，可以分为共阴极和共阳极两种。 七段数码管中，七个LED的编号顺序是固定的，如下图所示，点亮LED的位置不同，显示的符号也就不同。 在实际应用中，从节约端口数量、降低成本等角...
python七段数码管设计图案-python实现七段数码管和倒计时效果
weixin_37988176的博客
11-01 1090
8是典型的七段数码管的例子，因为刚好七段都有经过，这里我写的代码是从1开始右转。这是看Mooc视频写的一个关于用七段数码管显示当前时间# -*-coding:utf-8 -*-import turtle as timport timedef drawGap():t.penup()t.fd(5)def drawLine(draw):drawGap()t.pendown() if draw else ...
BCD-七段数码管显示译码器
热门推荐
林洋洋博客
10-18 11万+
问题及解决 1.要好好看看工作原理。 2.文件名必须与VHDL文件中的设计实体名保持一致。 总结：我个人感觉操作的规范化比较重要，如果操作不规范不仅使操作步骤繁琐，也有可能带来错误。其次是理解代码含义，了解BCD-七段数码管显示译码器的作用，清楚共阴极，共阳极的差别。应该可以比较顺利完成任务。
七段LED数码管显示译码器设计
qq_15008655的博客
10-26 7636
包含按键输入并显示模块，输入为四位16进制信号，同步在led数码管显示，如果没有输入，则自动脉冲计数 module led(comscan,clr,k,kon,kc,o,comscanout); input clr,kon; input [3:0]k; input [3:0]kc; input comscan; output  reg [7:0]o; reg [31:0]counter; reg...
七段显示译码器代码
05-30
以下是常见的七段显示译码器代码，使用的是常见的共阳极七段显示器： ```C //定义7段数码管COM口连接的芯片引脚 #define DIG_COM1 2 #define DIG_COM2 3 #define DIG_COM3 4 #define DIG_COM4 5 //定义7段数码管A~G连接的芯片引脚 #define SEG_A 6 #define SEG_B 7 #define SEG_C 8 #define SEG_D 9 #define SEG_E 10 #define SEG_F 11 #define SEG_G 12 //定义数码管编码表 //共阳极七段显示器编码表 //0~9 const unsigned char SEG_NUM[] = { 0x3F, 0x06, 0x5B, 0x4F, 0x66, 0x6D, 0x7D, 0x07, 0x7F, 0x6F }; //A~F const unsigned char SEG_ALP[] = { 0x77, 0x7C, 0x39, 0x5E, 0x79, 0x71 }; //定义函数：数码管显示 void dispNum(unsigned char num, unsigned char point) { static unsigned char dig = 1; //关闭所有数码管 digitalWrite(DIG_COM1, HIGH); digitalWrite(DIG_COM2, HIGH); digitalWrite(DIG_COM3, HIGH); digitalWrite(DIG_COM4, HIGH); //设置显示数字 switch (dig) { case 1: digitalWrite(DIG_COM1, LOW); break; case 2: digitalWrite(DIG_COM2, LOW); break; case 3: digitalWrite(DIG_COM3, LOW); break; case 4: digitalWrite(DIG_COM4, LOW); break; default: break; } //显示数字 if (num <= 9) { //显示数字0~9 PORTB = SEG_NUM[num] | (point << 7); } else if (num >= 'A' && num <= 'F') { //显示字母A~F PORTB = SEG_ALP[num - 'A'] | (point << 7); } else { //显示其他字符 PORTB = 0x00 | (point << 7); } //更新数码管 dig++; if (dig > 4) { dig = 1; } } ``` 这段代码演示了如何使用 Arduino 控制七段显示器，其中定义了数码管 COM 口和 A~G 口的连接引脚，以及显示数字和字母的编码表。函数 `dispNum()` 可以根据输入的数字或字母，在数码管上实现显示。

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