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看到非常好的一个讲建立时间和保持时间(记录一下):
建立时间:
Tcycle + Tcapture > Tlaunch + Tck2q + Tdp + Tsetup
保持时间:
Tck2q + Tdp + Tlaunch > Thold + Tcapture
以上两者的差异就是Tmargin(设计裕量)
如果Tsetup违例,可以采用增加Tcycle(降频)、优化组合逻辑传输延时(Tdp变小)、更换高速时序逻辑单元(Tck2q变小);
如果Thold违例,可以采用增加组合逻辑延时(Tdp变大)等