Verilog HDL实战操作③——时序电路设计

最新推荐文章于 2022-11-08 21:22:18 发布
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分类专栏： Verilog HDL
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本文链接：https://blog.csdn.net/qq_44981039/article/details/106605422
版权
本文介绍了74HC160作为同步十进制计数器的原理和使用，以及74HC161/162/163的特性。在时序电路仿真中，重点讲解了如何设置使能端和时钟信号来观察计数器的变化。74HC160/162为同步复位，而74HC161/163为异步复位，两者在Verilog HDL代码编写时存在差异。
摘要由CSDN通过智能技术生成

写在前面的小知识：

74HC160是应用最广泛的时序逻辑器件，分为同步计数器和异步计数器两大类。计数器根据计数容量又可分为二进制、十进制和其它进制计数器，根据计数方式又可分加法、减法和加/减计数器三种类型。74HC160为常用的同步十进制计数器

1.74HC160

module HC160(CLK,Rd_n,LD_n,EP,ET,D,Q,CO);
         input CLK;
         input Rd_n,LD_n,EP,ET;
         input [3:0] D;
         output reg [3:0] Q;
         output CO;
         assign CO = ((Q == 4'b1001) &ET);      // 进位逻辑
         always @(posedge CLK or negedge Rd_n)  // 计数逻辑
            if
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