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RSS订阅原创 C语言平衡二叉排序树：学生管理系统
#include <stdio.h>#include <stdlib.h>#include <string.h>#define MAX(A, B) ((A)>(B)?(A):(B)) #define Malloc(type) (type*)malloc(sizeof(type)) struct stu_grade{ char stu_name[15];//姓名 float grade;//成绩 char number[15];//编号（学.
2022-01-03 15:09:34
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原创 C语言顺序栈实现计算器：可以计算小数和数的平方等等
#include<stdio.h>#include<string.h>#include<stdlib.h>#include<Windows.h>#include<math.h>#define max 100#define Malloc(type) (type*)malloc(sizeof(type))typedef struct stack{ double data[max]; int top;}stack;//字符栈.
2022-01-03 15:07:05
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原创 c++课程设计：飞机大战（图形化界面）
飞机大战.cpp#include <iostream>#include <graphics.h>#include <time.h>#include <vector>#include "Plane.h"#include "runtime.h"using namespace std;int main(){ bool sign = false; //标记我方爆炸效果显示 bool state = false; //..
2021-12-28 15:17:53
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原创 c语言课程设计：图书管理系统
单链表，文件读写，使用时需要两个文件：图书.txt，借书人.txt增删查改，借书还书，简单的程序，一看就明白dev写的#include <stdio.h>#include <stdlib.h>#include <string.h>#include <conio.h>//带参宏定义Malloc给type分配空间 #define Malloc(type) (type*)malloc(sizeof(type))#define cls() s
2021-12-28 15:05:37
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原创 educoder数字逻辑实训：计数器设计与应用-24小时计时器（Logisim）
第1关：4位递增计数器的设计任务描述本关任务：设计一个4位二进制（十六进制）同步递增计数器，要求具有同步置数、异步清零功能。第2关：六进制计数器的设计任务描述本关任务：在第1关设计的计数器基础上，利用反馈原理设计一个六进制计数器，要求具有同步置数、异步清零功能。第3关：十进制计数器的设计任务描述本关任务：在第1关设计的计数器基础上，利用反馈原理设计一个十进制计数器，要求具有同步置数、异步清零功能。第4关：60进制计数器的设计任务描述本关任务：...
2021-12-28 14:53:02
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原创 educoder数字逻辑实训：寄存器设计与应用（Logisim）
第1关：基本寄存器的设计任务描述本关任务：在Logisim中，构建由4个D触发器构成的4位基本寄存器，要求上升沿触发，具有异步复位功能。第2关：移位寄存器的设计任务描述本关任务：在Logisim中，构建由4个D触发器构成的4位右移移位寄存器，要求上升沿触发，具有异步复位功能。第3关：循环移位寄存器的设计任务描述本关任务：在Logisim中，构建由4个D触发器构成的4位循环右移移位寄存器，要求上升沿触发，具有异步复位功能以及并行数据同步加载功能。第4关：并行..
2021-12-28 14:46:08
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原创 educoder数字逻辑实训：锁存器和触发器设计（Logisim）
第1关：基本SR锁存器的设计任务描述本关任务：在Logisim中，构建由两个或非门构成的基本SR锁存器。第2关：门控SR锁存器的设计任务描述本关任务：在Logisim中，在基本锁存器的基础上构建门控SR锁存器。第3关：与非门构成的门控SR锁存器的设计任务描述本关任务：在Logisim中，用四个与非门构建门控SR锁存器。第4关：门控D锁存器的设计任务描述本关任务：在Logisim中，用四个与非门构建门控D锁存器。第5关：主从D触...
2021-12-28 14:42:04
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2
原创 educoder数字逻辑实训：比较器设计（Logisim）
第1关：1位比较器设计任务描述本关任务：在Logisim中完成1位比较器电路的绘制并完成测试。第2关：2位比较器设计任务描述本关任务：在Logisim中完成2位比较器电路的绘制并完成测试。第3关：4位无符号比较器设计任务描述本关任务：在Logisim中完成4位比较器电路的绘制并完成测试。第4关：16位无符号比较器设计任务描述本关任务：利用在第3关中已经设计完成的4位无符号比较器（4个）级联构建16位无符号比较器。...
2021-12-28 14:33:19
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原创 educoder数字逻辑实训：加法器设计（Logisim）
第1关：半加器设计任务描述本关任务：利用在Logisim中的“组合逻辑分析”工具自动生成半加器电路。第2关：全加器设计任务描述本关任务：请根据教材中的全加器原理图在Logisim中手工绘制全加器电路。第3关：行波进位加法器设计任务描述本关任务：在Logisim中，利用上一关设计的全加器FA级联设计一个4位的行波进位加法器。第4关：1位十进制加法器设计任务描述本关任务：在Logisim中，利用上一关的4位加法器来设计一个1位十进制数（8.
2021-12-28 14:28:47
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原创 educoder数字逻辑实训：多路选择器设计与应用（Logisim）
第1关：2选1选择器设计任务描述本关任务：在Logisim中绘制2选1多路选择器，先在本地完成测试，体验数据选择的功能，然后在线完成测评。第2关：4选1选择器设计任务描述本关任务：在Logisim中利用上一关的2选1选择器级联设计一个4选1多路选择器。第3关：8选1选择器设计任务描述本关任务：利用前面两关的选择器级联设计一个8选1多路选择器。第4关：多路选择器的应用任务描述本关任务：在Logisim中选择在前面关卡中设计的多路选择器进行组合
2021-12-28 14:23:55
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原创 educoder数字逻辑实训：译码器设计与应用（Logisim）
第1关：2-4译码器设计任务描述本关任务：在Logisim中，绘制一个高电平有效2线-4线译码器，使能Enable高电平有效。第2关：3-8译码器设计任务描述本关任务：在Logisim中，利用上一关中设计的2-4译码器级联来构建3-8译码器，使能信号Enable高电平有效。第3关：低电平译码器LS138设计任务描述本关任务：在Logisim中，设计一个低电平有效的3-8译码器，使能信号有三个：G1、nG2a、nG2b。集成电路编码74LS138。第4关
2021-12-28 14:14:13
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原创 educoder数字逻辑实训：逻辑函数及其描述工具
第1关：根据布尔表达式绘制电路第2关：根据真值表绘制电路第3关：根据简化真值表绘制电路第4关：根据波形图绘制电路第5关：根据卡诺图绘制电路
2021-12-28 13:50:43
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空空如也
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