Verilog之初章---自用

已于 2023-01-30 22:00:57 修改
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分类专栏： verilog 文章标签： 学习 fpga开发
于 2023-01-30 21:58:04 首次发布
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本文链接：https://blog.csdn.net/qyf158236/article/details/128606470
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这篇博客介绍了Verilog语言的基础知识，它是一种广泛应用于数字电路系统寄存器传输级建模和验证的硬件描述语言，具有类似C语言的语法。文章适合初学者了解Verilog的用途和基本概念。
摘要由CSDN通过智能技术生成

语言简介

Verilog语言是一种用于建模电子系统的硬件描述语言，这种硬件描述语言最多的用于进行数字电路系统的寄存器传输级建模和验证工作，同时一些例如生物电路等数模混合电路的建模和验证电路。Verilog语言的语法规则与C语言有很多相似之处。

第一段代码
在这里插入图片描述

module mul_module( 
    mul_a     ,
    mul_b     ,
    clk       ,
    rst_n     ,
    mul_result
    );
    
    parameter    A_W = 4;
    parameter    B_W = 3
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