FPGA小技巧(1)

should not be used in output port

出现了这个错误,很奇怪。我在顶层文件里面明明是输出连输出,却出现了错误。

后来才发现顶层文件不能定义为reg型,就算它在下层文件里面是reg型,在顶层文件它只是一根线。所以要定义为wire型

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