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原创 vivado自定义ip导入vitis构建hardware报错(版本2023.1)

然后正常构建block design , export hardware,vitis中构建hareware project就行。

2024-04-30 17:50:17 115 1

原创 VScode断点调试ROS

包括c/c++,ros,cmake。

2023-11-30 22:33:40 1646

原创 基于ZCU104的PS和PL数据交互例程 系列目录

基于ZCU104的PS和PL数据交互例程(一):简介基于ZCU104的PS和PL数据交互例程(二):vivado中封装现有工程成IP基于ZCU104的PS和PL数据交互例程(三):vivado中创建IP基于ZCU104的PS和PL数据交互例程(四):vivado中制作Block Design基于ZCU104的PS和PL数据交互例程(五):Petalinux流程基于ZCU104的PS和PL数据交互例程(六):上板流程基于ZCU104的PS和PL数据交互例程(七):驱动编写与测试

2023-11-05 12:00:52 158

原创 基于ZCU104的PS和PL数据交互例程(七):驱动编写与测试

至此我们从最初设计到verilog实现IP,到block design创建整体架构,到petalinux生成镜像,再到linux运行已经成功走完。最后说一下,后面还会补一个ILA调试,因为下板之后,不方便debug,还是要走下ILA会方便点。另外就是如果是其他板卡,只需要对应替换IP的支持板卡,petalinux 的BSP包,就行如果是其他的加速器,想实现这种PS+PL的交互通信,做成演示demo。这个系列博客,可以为大家提供一种参考思路。

2023-11-05 11:57:03 823 4

原创 基于ZCU104的PS和PL数据交互例程(六):上板流程

烧录工具用v2.5版本的pynq镜像此时板子上运行的就是有。

2023-10-29 14:45:28 373 5

原创 基于ZCU104的PS和PL数据交互例程(五):Petalinux流程

虽然板卡是zcu104,但是对于类似的zcu102,这种ZYNQ系列都是类似的。下面的环境是在。

2023-10-26 16:55:28 1357

原创 VScode远程连接服务器的SSH配置

远程服务器需要按照ssh并且修改/etc/ssh/sshd_config。

2023-10-26 13:15:56 208

原创 在FPGA板卡上运行vins(一):简介

vslam是自动驾驶,移动机器人研究的热点,特别是在如何更好地部署到移动端。本系列在的基础上,在带有自定义的PL端的ubuntu系统中,配置vins环境,并且完成电脑端和板卡端的通信最终实现,

2023-10-25 18:38:58 116 1

原创 基于ZCU104的PS和PL数据交互例程(四):vivado中制作Block Design

(这里的cdma的中断引脚cdma_introut应该要跟ps的pl_ps_irq连接的,这里忘记连接了,但是后面生成镜像驱动也没有问题,可能是因为我后面使用轮询来操作的,如果想用中断操作,建议这里一定要连接上)配置成真双口,这里要注意BRAM的数据位宽和地址,这里数据位宽是32bit,跟DUT里面一致,就不再修改。连接clk_PL,start_DUT,DUT_finish,rst_n这些信号。默认PS给PL的时钟是100M,中断引脚打开,所以我们不再修改,完成配置。完成后,创建顶层文件,如下图选择。

2023-10-25 16:51:00 1289 1

原创 基于ZCU104的PS和PL数据交互例程(三):vivado中创建IP

以创建带有AXI-LITE接口的IP为例子。

2023-10-23 21:34:46 504

原创 基于ZCU104的PS和PL数据交互例程(二):vivado中封装现有工程成IP

外链图片转存中…(img-kLm0YRmg-1698065695418)]

2023-10-23 20:58:08 526 6

原创 基于ZCU104的PS和PL数据交互例程(一):简介

基于ZCU104的PS和PL数据交互例程

2023-10-22 11:28:18 464 3

原创 数字IC(一):亚稳态

亚稳态是指由于违背了触发器的建立和保持时间而产生的不确定状态,其本质是因为CMOS的电平处于不能判断是高电平还是低电平的区间。【所以一种减少亚稳态的方法就是使用建立和保持时间更短的逻辑器件(工艺制程小),一般是工艺越小,器件速度越快】亚稳态一般在1~2个时钟周期就会返回到稳态,但是不能确定返回是0还是1。一般来说,亚稳态容易出现在跨时钟(CDC,clock domain crossing)中。平均无故障时间,等于故障率的倒数,越大越好。可以理解成分母是(建立时间+保持时间)x时钟频率x。

2023-07-28 20:36:24 279 1

原创 利用Opencl加速Eigen矩阵(二)

经过实验发现如果计算量不够大,利用opencl反而浪费时间。所以本实验进行加速的原来代码如下:Matrix<double,8,8>A[64],B[64],D[64];//……//A,B,T,D初始化之后进行计算for(int i=0;i<64;i++){ D[i].noalias() +=A * B * A.transpose();}接下来进行opencl进行加...

2020-04-23 21:07:57 2009

原创 利用Opencl加速Eigen的矩阵运算(一)

很多时候OpenCL启用GPU加速大规模矩阵运算可以达到减少计算时间的目的。但是目前一般成熟代码里面的矩阵运算不会是简单的float数组或者double数组,而是通过特定的结构体进行计算。其中Eigen就是专门针对矩阵计算的库,里面涉及到大量的矩阵操作。那么如何用OpenCL对Eigen进行加速呢?简单来看就是将Eigen的矩阵结构体声明放到OpenCL的核函数中,但是本人技术浅薄,无法实现这一...

2020-04-07 08:36:08 1911 3

原创 dso代码分析-初始化篇

DSO初始化过程分析

2020-03-29 21:55:51 987

原创 WINDOWS10+VS2019+OPENCL安装教程

电脑显卡NIVIDA第一步:安装CUDA,其中在选择组件安装路径的时候可以自己新建文件夹安装CUDA第二步:配置VS2019,然后执行示例代码,ok配置相关链接和库...

2020-03-29 20:03:02 3364

基于ZCU104的PS和PL数据交互例程的DUT代码

基于ZCU104的PS和PL数据交互例程的DUT代码,先上传这个,后面整理好其他的资源也会上传的

2023-11-01

amba-axi的PDF

arm官网上获取的关于amba_axi协议的pdf

2023-10-25

vins-mono源码

vins-mono的github源码

2023-10-24

正点原子启明星FPGA开发资料

正点原子启明星FPGA开发资料,包括3个PDF,分别对应纯PL开发,SDK开发和linux开发。其中第二篇SDK开发对应博文https://blog.csdn.net/SHSHSHSH1/article/details/133998907?spm=1001.2014.3001.5502和https://blog.csdn.net/SHSHSHSH1/article/details/133999417?spm=1001.2014.3001.5502中的材料

2023-10-23

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