【PCIe DL_Feature详解】

DL_Feature的引入

   Data Link Control and Management State Machine在PCIe Gen4引入了DL_Feature这个状态,该状态主要用来协商PCIe link 两端是否支持新的DL Feature,目前为止DL Feature只引入了Scaled Flow Control 来提高Gen4及以上的效率。在这里插入图片描述
  DL_Feature 这个状态是可选的,当 Data Link Feature Extended Capability中Data Link Feature Exchange Enable field为0时状态机就会跳过DL_Feature子状态。

DL Link Feature Protocol 介绍

   链路两端port在DL_Feature子状态通过DL Link Feature Protocol进行协商,判断两端port是否都支持DL_Feature, 为了支持DL_Link Feature,Data Link Feature Extended Capability中包含Data Link Feature Capabilities 和Data Link Feature Status寄存器:
Data Link Feature Capabilities Register:
在这里插入图片描述
在这里插入图片描述

Data Link Feature Status Register:
在这里插入图片描述
在这里插入图片描述

DL_Feature sub-status行为

  1. 进入DL_Feature:
    • Remote Feature Supported valid 和Remote Feature Supported 都要设置都应该为0.
  2. 在DL_Feature子状态:
    • PCIe Link 两端发送DL_Feature DLLP 进行协商,发送的Feature Supported 域要与Data Link Feature Capabilities Register中Local Feature Supported Field 一致,Feature Ack要与Data Link Feature Status Register中Remote_Data_Link_Feature_Supported_Valid保持一致, Remote_Data_Link_Feature_Supported 表示收到的DL_feature 中的Feature_Support 信息有效。
  3. 退出DL_Feature:
    • 收到InitFc1 DLLP
    • 收到Feature Ack
    • 收到MR_IOV Init DLLP

  下面以一个例子来具体说明DL_Feature Protocol:
Example: Local Port Initial DL Link Feature Protocol
Step 1.

  • Local Port transmit DL Link Feature DLL with DL Feature Supported bit equal to Data Link Feature Field in Data Link Control Capability Register
  • DL_Feature ACK = 0

Step 2.

  • Local Port record Remote Feature Supported bit, if Remote Data Link Feature Supported Valid is zero.
  • Check Remote Feature Ack from remote Port.

Step 3.

  • Local Port transmit Remote Feature Ack equal to the Remote_Data_Link_Feature_Supported_Valid recorded from Step 2 to Remote Port.

Note: 只有当为Remote_Data_Link_Feature_Supported_Valid零的时候port才会去采样对端发来的DL_feature中feature support信息.
在这里插入图片描述

Vivado是Xilinx公司推出的综合开发环境,用于实现FPGA芯片的设计。其中,Vivado PCIe cfg_fc_ph指的是PCIe Endpoint的配置。PCIe(Peripheral Component Interconnect Express,外设组件互连扩展)是一种高速的、低延迟的计算机总线,特别适用于连接外部设备和处理器之间的高速数据传输。而PCIe Endpoint是PCIe总线上接口的一种,其附加在计算机外围的设备上,可作为计算机系统的内部或外部设备使用。 PCIe Endpoint在Vivado中的配置是通过cfg_fc_ph寄存器进行的。该寄存器用于控制PCIe传输,其中,cfg表示该寄存器用于配置Endpoint设备,fc表示该寄存器用于流控方式的选择,ph表示该寄存器是PHY在物理层面生成和检测的传输的标志。具体来说,cfg_fc_ph寄存器主要包括以下配置信息: 1. PCIe Endpoint设备的ID信息,包括Vendor ID(Vid)、Device ID(Did)等; 2. 物理层面的传输控制信息,包括不同的流控方式(如成功传输Acknowledge、端到端流控等); 3. 数据传输和传输层面的配置信息,包括传输协议、数据立即传输等。 通过设置cfg_fc_ph寄存器中的这些信息,可以实现对PCIe传输的控制和配置,确保数据传输的准确性和高效性。而在Vivado中,可以通过IP核来创建和配置PCIe Endpoint设备,以实现与计算机系统的高速数据传输。同时,Vivado也提供了强大的仿真和调试功能,以支持对PCIe传输的可靠性验证和故障排查,以确保PCIe设备的稳定性和可靠性。
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