quartus Ⅱ 12.1 使用教程（3）点亮LED灯

虚无缥缈vs威武

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分类专栏： quartus Ⅱ 文章标签： fpga开发 quartus led

于 2019-08-05 10:40:18 首次发布

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本文介绍如何使用Quartus 12.1软件和Verilog HDL语言，在EP4CE15F23C8开发板上实现四个LED灯的点亮与闪烁。详细步骤包括创建项目、编写代码、编译、管脚分配及下载配置。

摘要生成于 C知道，由 DeepSeek-R1 满血版支持，前往体验 >

开发板使用的是EP4CE15F23C8，软件使用的是quartus 12.1 ，工程实现的功能是点亮四个LED灯

打开quartus软件

step1 点击File-->New Project Wizard

点击Next

填写工程名led_test，点击Next

点击Next

选择开发板型号，点击Next

点击Next

点击Finish

新建完成后，如下图所示

step2 新建verilog工程文件

点击File -->New

选择Verilog HDL File，点击OK

led_test程序，写得比较简单基本都可以看懂

module led_test(
  i_clk,
  i_rst_n,
  led_1,
  led_2,
  led_3,
  led_4

);



//clk  50M  
// 周期为1s,正负周期各0.5s,输入时钟频率50M周期为20ns，计数25000000-1翻转一次
localparam	count_delay  =  25000000-1;

input	i_clk;
input	i_rst_n;
output	led_1;
output	led_2;
output	led_3;
output	led_4;

reg	[24:0]led_cnt;
reg	led_out;

// 计数0.5s
always@(posedge i_clk or negedge i_rst_n)begin
		if(i_rst_n == 1'b0)
			led_cnt	<=		25'd0;
	   else if(led_cnt == count_delay)
			led_cnt	<=		25'd0;
		else
			led_cnt	<=		led_cnt	+ 1'b1;
end			


// 每0.5s led_out翻转一次		
always@(posedge i_clk or negedge i_rst_n)begin
		if(i_rst_n == 1'b0)
			led_out	<=		1'b0;
	   else if(led_cnt == count_delay)
			led_out	<=		~led_out;
		else
			led_out	<=		led_out;
end

// 将led_out的电平给四个led

assign	led_1	=	led_out;
assign	led_2	=	led_out;
assign	led_3	=	led_out;
assign	led_4	=	led_out;

endmodule

点击Comple Design进行编译