文献阅读（244）Accelergy&Timeloop

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分类专栏： 编译优化 文章标签： 硬件架构
于 2020-10-10 15:39:46 首次发布
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版权
  • 题目：Accelergy: An Architecture-Level Energy Estimation Methodology for Accelerator Designs
  • 时间：2019
  • 会议：ICCAD
  • 研究机构：MIT
  • 代码：http://accelergy.mit.edu

1 abstract & introduction

过去只有完成物理布局布线才能预测出能耗，而且仿真时间太长。
这篇论文专注于功耗评估，与Eyeriss的精度相比达到了95%的精度

在这里插入图片描述
其中能量的计算就靠两部分，一个是ERT，记录每次action消耗多少能量，然后根据action counts通过Energy Calculator计算出能耗

  • 题目：Timeloop: A Systematic Approach to DNN Accelerator Evaluation
  • 时间：2019
  • 会议：IEEE International Symposium on Performance Analysis of Systems and Software (ISPASS)
  • 研究机构：NVIDIA/MIT

1 abstract & introduction

Timeloop是一个用于评估和探索DNN加速器的体系结构设计空间的基础结构，可以统一的描述多种DNN架构

Timeloop is an infrastructure for evaluating and exploring the architecture design space of DNN accelerators

Timeloop主要包含两部分：

  • 一个是对性能、面积和功耗的建模
  • 一个是在给定架构上负载的映射

a mapper to construct and search through the mapspace of any given workload on the targeted architecture

在这里插入图片描述

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