CPRI原理及应用--基本原理

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于 2023-03-08 17:33:50 首次发布
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CPRI原理及应用-基本原理篇

基本解释

CPRI，英文全称Common Public Radio Interface，中文全称：公共无线接口，主要用与无线通信无线设备控制中心（简称REC）及无线设备（简称RE）之间的信息传输。根据不同无线通信带宽和功能演进，CPRI速率可达25Gbps，同时产生了eCPRI。

CPRI历史

2003年4月，由爱立信、华为、NEC、北电网络及西门子公司发起成立CPRI 组织。
2003年9月发布了CPRI标准的1.0版本，通过制定开放性的标准接口，将基站分成无线设备（RE）和无线设备控制部分（REC）。
2.0版本于2004年10月发布，该版本支持W-CDMA、CDMA2000、TD-SCDMA等多种无线通信标准。
最新的版本7.0是2015年10月发布。

CPRI协议

CPRI是一种数字协议，用于当代基站的两个部分之间的串行高速数据传输，即无线电设备控制（REC），也称为基带单元（BBU），无线电设备（RE）也称为远程无线电单元（RRU）或远程无线电头（RRH）
传输方式：光或电
特点：全双工，同步和稳定传输，高带宽、高吞吐量以及低延迟。
CPRI基本架构

用户面数据：U-plane，基站和移动设备之间传输的 IQ 数据模式的数据
控制和管理面数据：C&M-plane
M-plane对 CPRI 链路和 RE 操作、管理和维 护的管理信息。
C-plane：用于调用进程的控制数据流。
同步面数据：SYNC，REC 和 RE 之间传输的同步和定时信息的数据流
CPRI协议分层
CPRI线速率
• option 1: 614.4 Mbit/s, 8B/10B line coding (1 x 491.52 x 10/8 Mbit/s)
• option 2: 1228.8 Mbit/s, 8B/10B line coding (2 x 491.52 x 10/8 Mbit/s)
• option 3: 2457.6 Mbit/s, 8B/10B line coding (4 x 491.52 x 10/8 Mbit/s)
• option 4: 3072.0 Mbit/s, 8B/10B line coding (5 x 491.52 x 10/8 Mbit/s)
• option 5: 4915.2 Mbit/s, 8B/10B line coding (8 x 491.52 x 10/8 Mbit/s)
• option 6: 6144.0 Mbit/s, 8B/10B line coding (10 x 491.52 x 10/8 Mbit/s)
• option 7: 9830.4 Mbit/s, 8B/10B line coding (16 x 491.52 x 10/8 Mbit/s)
• option 7A: 8110.08 Mbit/s, 64B/66B line coding (16 x 491.52 x 66/64 Mbit/s)
• option 8: 10137.6 Mbit/s, 64B/66B line coding (20 x 491.52 x 66/64 Mbit/s)
• option 9: 12165.12 Mbit/s, 64B/66B line coding (24 x 491.52 x 66/64 Mbit/s)
• option 10: 24330.24 Mbit/s, 64B/66B line coding (48 x 491.52 x 66/64 Mbit/s)

CPRI帧格式

基本单位：基本帧
TC = 1/fc = 1/3.84 MHz = 260.416667ns

256个基本帧组成一个超帧

150个超帧组成一个10ms帧
（260.4ns * 256 * 150 = 10ms）

不同线速率下基本帧周期均为260.416667ns，线速率越高基本帧内的信息数量越多
CPRI帧格式
一个基本帧内数据分为16个块（W），每个块的数据量用byte表示（Y），线速率不同Y不同，Y=0~47，CPRI基本帧格式如下图所示。
CPR i基本帧格式
CPRI基本帧的定义：
1.W=0为控制字，W=1~15为IQ数据；
2.不同速率下byte数量（Y）不同，如10.1376Gbps下Y=0~19（bit长度T = 20*8 = 160）；
3.需要注意的是，在10G及以上速率，控制字仅16byte，W=0且Y大于15的控制字位置为保留数据；
4.在时域上，串行数据传输顺序为W0的Y0-Y47，W1的Y0-Y47，依次类推，最后传输W15的Y0~Y47
CPRI基本帧控制字定义
对于CPRI 控制字，协议将１个超帧（256基本帧）的控制数据划分为一个“子通道”，将子通道内超帧内的控制字进行行列划分，分为4列X64行，每64个基本帧组成1列。如下图所示。
CPRI控制字划分
CPRI控制字定义
CPRI控制字详细定义

CPRI建立连接

CPRI建立连接流程如下：
A.等待
B.L1同步，收到正常的同步信号
C.总线版本匹配
D.C&M设置匹配
E.接口用户自定义匹配
F.建立链接
CPRI建立连接流程

CPRI时延

T12 ：R1-R2的传输延时；
T34 ：R3-R4的传输延时；
T14 ：R1-R2-R3-R4的传输延时
T2a ：R2-Ra的传输延时；
Ta3：Ra-R3的传输延时
T_offset:R2恢复帧头传递到R3的时间

CPRI时延模型
参考资料
[1]: CPRI Specification V7.0 (2015-10-09)

FPGA设计师
关注
CPRI（通用公共无线接口）协议中文版
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R&S公司基于其强大的技术实力，于业界首先推出了基于CPRI接口的RRU和BBU测试解决方案，进一步完善了基站领域的测试需求，可以更好地为运营商、基站设备商、直放站厂商和检测机构提供相应的测试服务。
CPRI协议理解——控制字内容
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接下来开始捋一下控制字的内容。汇总就是这个表格了。看起来似乎很多内容，但有些实际上是一些厂商特定的控制信息，这些是不需要太关注的。需要关注的只要有如下：同步相关：Ns = 0这一行慢速C&M:Ns = 1这一行版本、控制信号、P指针：Ns = 2这一行。FastC&M就是 Ns=P指针到63了这一行。其他的内容并不是通用的，或者保留的那就不需要关注。同时还要关注下Z表示法与XsNs标志的对应关系。
cpri协议中文介绍
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通用公共无线接口（CPRI）联盟是一个工业合作组织，致力于从事无线基站内部无线设备控 制中心（简称 REC）及无线设备（简称 RE）之间主要接口规范的制定工作。发起成立 CPRI 组 织的公司包括：爱立信、华为、NEC、北电网络及西门子公司。 目的：使 CPRI 规范灵活有效地对无线基站进行产品划分，独立地发展无线设备控制中心（简 称 REC）及无线设备（简称 RE）技术
CPRI协议讲解
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选项2（flexible position）：AxC 容器的第一个bit 被定位在IQ 数据块的一个偶数。选项1（packed position）：连续增序排列每个AxC 容器。简单来说IQ的映射是按照字长（T）一列一列的映射，竖着不是横的，看下图。控制字除外，从bit1到bit15 竖着一列一列的映射。IQ数据块中每个AxC 容器的位置由下述选项之一决定。具体一个基本帧里面有多少AxC？下图是一个字长（T=32）的基本帧。每个AxC 容器作为一个块发送。不允许交迭的AxC容器。
CPRI（4）信令
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CRPI协议的标准，小众，但是对需要的人来说非常实用，希望能有帮助！
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08-11
CPRI是BBU与RRU之间的互联协议，这个是中文版本的，便于理解，非常有利于理解该接口协议，低分分享。。。
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综上所述，CPRI-option8的物理层涉及到了帧结构、IQ数据处理、带宽配置以及时序同步等多个关键点，这些知识点对于4G/5G研发人员理解无线通信系统的底层工作原理极其重要。在实际应用中，理解并掌握这些细节能够帮助...
cpri verilog
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CPRI（Common Public Radio Interface）是一种用于无线通信系统的接口标准，它定义了数字基带处理机（BBP）和射频（RF）之间的接口协议。CPRI主要用于将无线基站的基带处理能力与射频链路分离，以便于基带处理与射频传输的灵活组合和互换。在实现的过程中，一种常用的方式是使用Verilog语言编写CPRI接口的硬件描述代码。 Verilog是一种硬件描述语言，用于描述电子系统的行为和结构。在编写CPRI的硬件描述代码时，Verilog可以被用于实现CPRI接口的基带处理机和射频的通信协议。通过使用Verilog，可以实现CPRI连接中的各种功能，如通信协议的封装和解包、数据帧的传输、时钟同步和通信速率的控制等。 编写CPRI Verilog代码时，需要根据CPRI接口的规范和需求，定义寄存器、数据结构和逻辑电路等，以实现所需功能。Verilog语言具有较高的可维护性和可重用性，可以方便地进行功能调整和扩展。通过仿真和验证，可以确保CPRI Verilog代码的正确性和性能。 总之，CPRI Verilog是一种用于实现无线通信系统接口标准的硬件描述语言代码。通过编写CPRI Verilog代码，可以实现基带处理机和射频的通信协议，并实现基站的灵活组合和互换，从而提高无线通信系统的性能和可靠性。
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