Verilog状态机学习笔记

最新推荐文章于 2024-04-30 16:25:56 发布
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这篇博客详细介绍了Verilog中状态机的设计，包括状态空间定义、状态跳转的时序逻辑、下个状态的组合逻辑判断以及各状态下的具体动作。通过对状态机四段论的阐述，帮助读者理解如何在FPGA中实现状态机。
摘要由CSDN通过智能技术生成

Verilog学习记录之状态机设计

状态机设计

四段论

  1. 状态空间定义
  2. 状态跳转
  3. 下个状态判断
  4. 各状态下的动作

1.状态空间定义

状态空间是区分状态机工作在不同状况下的标志，用常量定义。

parameter SLEEP = 2'b00;
parameter STUDY = 2'b01;
parameter EAT = 2'b 10;
parameter AMUSE = 2'b11;
reg [1:0] current_state;
reg [1:0] next_state;

2.状态跳转(时序逻辑)

always @(posedge clk or negedge rst_n)
begin
       if (!rst_n)
         current_state <= SLEEP;
       else 
         current_state
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