Vivado 2018.3 SDK闪退解决

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问题描述:

运行【File】-》【Launch SDK】,进度条前进一点就闪退了

思路:

①可能是后台残余sdk进程,重启即可
②可能是某处的sdk缓存导致的问题,需要清除缓存

问题解决:

方法一:

重启电脑,重启SDK

方法二:

①将【工程.sdk】重命名为【任意其他名称】,相当于清除缓存

②导出硬件
【File】-》【Export】-》【Export Hardware】

③运行sdk
【File】-》【Launch SDK】
//此步vivado会自动新建【工程.sdk】目录

④复制
进入刚才重命名的sdk文件夹,复制工程内容到新的【工程.sdk】

⑤导入

  • 【File】-》【Import】-》【General】-》【 Projects from Folder or Archive】
  • 选择【工程.sdk】目录,导入需要的文件夹或源码
    在这里插入图片描述
    ⑥重建工程
  • 对于fsbl及bsp等,因为重新导入硬件,故建议新建,名称需要跟之前一致
  • 【File】-》【New】-》【Application Project】
  • 【File】-》【New】-》【Board Support Package】
    在这里插入图片描述

⑦重编译
工程【右键】-》【Clean Project】

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Vivado 2018.3 是 Xilinx 公司推出的一款 FPGA 开发工具,其中包含了 Vivado Design Suite 和 Vivado SDK 两个部分。Vivado SDK 是用于 FPGA 软件开发的工具,可以帮助用户进行嵌入式软件开发、调试和测试等工作。下面是 Vivado 2018.3 SDK 的使用教程: 1. 打开 Vivado 2018.3 工具,选择“Create New Project”创建一个新项目。 2. 在“Create New Project”对话框中,输入项目名称和存储路径,然后点击“Next”。 3. 在“Add Sources”对话框中,选择“Create Block Design”,然后点击“Next”。 4. 在“Create Block Design”对话框中,输入设计名称和存储路径,然后点击“OK”。 5. 在“Diagram”窗口中,右键单击空白处,选择“Add IP”,然后选择需要添加的 IP 核。 6. 在“Diagram”窗口中,连接 IP 核之间的信号线。 7. 在“Sources”窗口中,右键单击设计文件夹,选择“Create HDL Wrapper”,然后点击“OK”。 8. 在“Sources”窗口中,右键单击设计文件夹,选择“Generate Bitstream”,然后点击“OK”。 9. 在“File”菜单中选择“Export Hardware”,然后勾选“Include bitstream”选项,点击“OK”。 10. 在“File”菜单中选择“Launch SDK”,然后选择“Create a new SDK workspace”,点击“OK”。 11. 在“SDK”窗口中,选择“File”菜单中的“New”->“Application Project”,输入项目名称和存储路径,然后点击“Next”。 12. 在“Platform”对话框中,选择“Use existing platform”,然后选择之前导出的硬件平台文件,点击“Finish”。 13. 在“SDK”窗口中,右键单击新建的应用程序项目,选择“New”->“Source File”,输入文件名和存储路径,然后点击“Finish”。 14. 在新建的源文件中编写代码,然后点击“Build Project”进行编译。 15. 在“SDK”窗口中,选择“Xilinx”菜单中的“Program FPGA”,然后选择之前生成的 bit 文件,点击“Program”。

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