为了帮助无基础的童鞋们尽快跨入RISCV架构处理器设计的大门,本公众号将推出一个系列的入门基础推文,每次只涉及一到两个知识点,将覆盖RISCV架构的基础、verilog语言应用、modelsim仿真、FPGA实现、windows下集成应用软件等知识,由于本公众号需要覆盖本人的多门课程,要兼顾各方面童鞋,本系列不会每天更新,但至少每周更新一到两次,节假日和学院重大活动除外。
RISCV(RV32)具有32个整数寄存器组(取名为:x0~x31),其中31个是通用寄存器(x1~x31),它们存储整数数值,寄存器x0是硬件连线的常数0。当你设计的RISCV架构处理器实现了浮点扩展时,还必须有32个浮点寄存器f0~f31。对于RV32,其x寄存器是32位宽度的,XLEN=32,对于RV64,它们是64位宽度的,XLEN=64。
其中RISC-V寄存器调用约定如下图: