ADC架构种类说明 FLASH_架构ADC 可达GHz级别Pipeline_ADC架构SAR ADC架构[](https://img-blog.csdnimg.cn/d42b65568b6648ec92b04e7b6c53fa0d.png?x-oss-process=image/watermark,type_d3F5LXplbmhlaQ,shadow_50,text_Q1NETiBA6Ieq5bCP5ZCD5aSa,size_20,color_FFFFFF,t_70,g_se,x_16) FLASH_架构ADC 可达GHz级别 通过电阻分压再经过比较器进行输出数字信号 再经过编码器 为什么会那么快的速度呢?是因为它是并行处理的 快慢主要看比较器转换速率 Pipeline_ADC架构 Pipeline_ADC主要思想是将ADC进行对半分进行比较,符合再次进行对半分比较… 量化误差 数据数字对应特定的一点范围的电压值 主要看起分辨率的大小 SAR ADC架构 模拟输入信号 -> 采样保持电路 -> 减法器 -> 比较器 -> SAR