以同步右移移位寄存器为基础, 设计001010序列信号发生器

本文介绍了如何利用同步时序逻辑电路,特别是同步右移移位寄存器,来设计一个001010序列信号发生器。通过分析序列特性,确定了无重复状态的状态顺序表,并着重设计了电路的D0输入,以确保自启动功能。最后,使用2片74151和一片非门构建16选1数据选择器完成设计,并绘制了电路原理图。
摘要由CSDN通过智能技术生成

        对于序列信号001010, 选择四位: 0010->0101->1010->0100->1000->0001->0010->...... 无重复状态, 则选择该种设计方案(若选择三位会产生重复状态).

        由此, 得到状态顺序表.

状态顺序表
CLK顺序 Q3 Q2 Q1 Q0
0 0 0 1 0
1 0 1 0 1
2 1 0 1 0
3 0 1 0 0
4 1 0 0 0
5 0 0 0 1
6 0 0 1 0

        由状态顺序表, 可以看出需要的序列信号由Q3端输出.

        根据状态顺序表, 再使电路具备自启动功能, 有下述状态表.

状态表
Q3 Q2 Q1 Q0 Q3* Q2* Q1*
评论 1
添加红包

请填写红包祝福语或标题

红包个数最小为10个

红包金额最低5元

当前余额3.43前往充值 >
需支付:10.00
成就一亿技术人!
领取后你会自动成为博主和红包主的粉丝 规则
hope_wisdom
发出的红包

打赏作者

好梦成真Kevin

你的鼓励将是我创作的最大动力

¥1 ¥2 ¥4 ¥6 ¥10 ¥20
扫码支付:¥1
获取中
扫码支付

您的余额不足,请更换扫码支付或充值

打赏作者

实付
使用余额支付
点击重新获取
扫码支付
钱包余额 0

抵扣说明:

1.余额是钱包充值的虚拟货币,按照1:1的比例进行支付金额的抵扣。
2.余额无法直接购买下载,可以购买VIP、付费专栏及课程。

余额充值