Quarters II报Verilog语法near text “ã“； expecting a direction错误

最新推荐文章于 2024-10-08 10:31:20 发布
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分类专栏： Quarters II
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参考链接：Quartus 11进行编译Compile Design的时候出现错误near text ã
博主在编译代码时，遇到编译器报这个错误，定位到该错误点后，并没有发现明显的代码错误，屏蔽这三条语句编译器又可以正常编译，截图如下：
在这里插入图片描述
通过Tools-Options-Text Editor-Show White Space(显示空格字符)，可以看到后面空白的地方并不是正真的空格，就导致编译器报错，删除红色方框内的这些非空格字符后，编译器正常编译程序。
在这里插入图片描述
至于具体什么原因导致编译器报错，有知道的大神评论留言下！！！！

风陵.
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【Verilog-HDLBits刷题】2022.02.20学习笔记
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