DSP C2000系列TMS320F28335学习之外部存储器接口XINTF

1、为什么要有外部存储器接口XINTF?

对于复杂的应用而言,28335内部集成的存储器FLASH、SRAM和ROM可能不够用,因此通过XINTF接口进行扩展外部存储空间。

2、了解XINTF接口

XINTF接口有3个固定存储器映射区域:Zone0、Zone6、Zone7,通过对片选线XZCS0、XZCS6、XZCS7置低选择对应读写区域。
在这里插入图片描述
时钟-75MHz
XINTF时钟设置为75MHz。
时钟决定访问时序,访问时序以内部时钟XTIMCLK为基准,设置为系统时钟SYSCLKOUT的一半:
SysCtrlRegs.PCLKCR3.bit.XINTFENCLK = 1;
XINTCNF2.XTIMCLK = 0x01;

3、访问操作-SRAM

选择Zone0区域:
1、定义地址,如:Uint16 * SRAM_StartAddr = (Uint16 * ) 0x4041;
#define SRAM_StartAddr * SRAM_StartAddr
2、初始化,20位地址线(XA0-XA19)、16位数据线(XD0-XD15)、XZCS0片选线置低;
3、写:SRAM_StartAddr = 3600;
4、读:if(SRAM_StartAddr == 3600) return ture;
else return false

4、写后读的流水线保护

问题:28335多级流水机制,一次操作中,读相位超前于写相位
目标:写后读
实际:读后写
结果:导致读数据结果不是最新的数据,读的旧数据

注意:具有保护机制的区域,CPU会自动将读操作指令后插入空时钟周期以便在读操作前完成写操作,Zone0区域具有此保护功能。

那没有此保护功能的区域怎么解决此问题?
软件上实现保护机制的功能,使其起到相同效果。
1、在写和读的操作之间插入3个NOP指令;
2、在写和读的操作之间插入超过3个周期的指令;

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1 TMS320F2833x,TMS320F2823x DSC .................................................................................. 10 1.1 特性......................................................................................................................... 10 1.2 开始使用.................................................................................................................... 11 2 简介.................................................................................................................................. 12 2.1 引脚分配.................................................................................................................... 14 2.2 信号说明.................................................................................................................... 23 3 功能概述............................................................................................................................ 33 3.1 内存映射.................................................................................................................... 34 3.2 简要说明.................................................................................................................... 41 3.2.1 C28x CPU ....................................................................................................... 41 3.2.2 内存总线(哈弗总线架构) .................................................................................... 41 3.2.3 外设总线......................................................................................................... 41 3.2.4 实时JTAG 和分析.............................................................................................. 42 3.2.5 外部接口(XINTF) ................................................................................................ 42 3.2.6 闪存............................................................................................................... 42 3.2.7 M0,M1 SARAM ............................................................................................... 42 3.2.8 L0, L1, L2, L3, L4, L5, L6, L7SARAM ........................................................................ 43 3.2.9 引导ROM ........................................................................................................ 43 3.2.9.1 引导加载器使用的外设引脚....................................................................... 44 3.2.10 安全性............................................................................................................ 44 3.2.11 外设中断扩展(PIE) 块......................................................................................... 46 3.2.12 外部中断(XINT1-XINT7,XNMI) ............................................................................. 46 3.2.13 振荡器和锁相环(PLL) .......................................................................................... 46 3.2.14 安全装置......................................................................................................... 46 3.2.15 外设时钟......................................................................................................... 46 3.2.16 低功率模式....................................................................................................... 46 3.2.17 外设帧0,1,2,3 (PFn) ...................................................................................... 47 3.2.18 通用输入/输出(GPIO) 复用器................................................................................. 47 3.2.19 32 位CPU 定时器(0,1,2) .................................................................................. 47 3.2.20 控制外设......................................................................................................... 48 3.2.21 串行端口外设.................................................................................................... 48 3.3 寄存器映射................................................................................................................. 49 3.4 器件仿真寄存器............................................................................................................ 51 3.5 中断.......................................................................................................................... 52 3.5.1 外部中断......................................................................................................... 56 3.6 系统控制.................................................................................................................... 57 3.6.1 OSC 和PLL 块.................................................................................................. 58 3.6.1.1 外部基准振荡器时钟选项.......................................................................... 59 3.6.1.2 基于PLL 的时钟模块.............................................................................. 60 3.6.1.3 输入时钟损失....................................................................................... 61

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