[有更新]10分钟教你完成Verilog-Vscode编辑器环境搭建

西北旺梁朝伟

已于 2022-11-22 20:51:26 修改

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分类专栏： FPGA开发文章标签： fpga开发

于 2022-03-18 20:38:12 首次发布

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网络上有大量的如何在Vscode下搭建Verilog编辑环境的文章，但是部分文章存在过时的情况，或者存在内容缺失的情况，这里整理了部分有用的文档，个人尝试并配置了一个适合自己的环境。

推荐插件

Chinese

在这里插入图片描述毫无疑问，中文Chinese插件是必须需要的。别提什么我们是cs的，我们需要接收全英文的环境，没那么多功夫折腾这个，我打赌你配好了环境以后800年不会再看一眼菜单栏。

Tabout

在这里插入图片描述
这是一个非常有用的跳出括号的插件，当你在括号中写完了语句之后只需要用你的左手小拇指轻轻按一下左上角的tab键就能自动跳到括号外面去了，不需要你移动右手到小键盘区域来一个一个地按->键。

Verilog-HDL/SystemVerilog/Bluespec SystemVerilog

在这里插入图片描述

Verilog必备，但是注意下载好了这个软件还需要进行一系列的配置。

我这里使用的是Xilinx的Vivado套件，所以只介绍Vivado的xvlog怎么配合使用。

首先你需要将你的Vivado安装目录下面的bin文件夹加入到环境变量PATH里面，用户变量和系统变量都加进去吧，毕竟这两者我也分不清。加完了之后应该如下图所示。
在这里插入图片描述
PATH在哪里？你认真的？
右键我的电脑，点击属性，点击右侧的高级系统设置，点击高级下面的环境变量。好了，现在你看到了有用户变量和系统变量这两个分开的模块了吧。

完成了这个工作之后你可以在重启vscode之后测试一下xvlog时候被vscode读取了，打开vscode的终端，输入xvlog --version，你应该会看到如下图所示的vscode的回复。如果有了，那么xvlog就装好了，要不然还请重试几次。
在这里插入图片描述

装好了xvlog之后还需要安装ctags来支持我们能够在代码中随时查看某个变量的定义，就像下图这样。
在这里插入图片描述

请去ctags-release下载最新的ctags压缩包，如果你是64位电脑请下载x64.zip，如果你是32位电脑请下载x86.zip。下载完了之后解压这个压缩包，放在一个不含中文字符的路径下面，然后按照xvlog添加环境变量那样，把解压出来的文件夹也放到两个环境变量里面。比如我就将这个压缩包解压成一个名字叫做ctags的文件夹放在D盘下面。然后你需要在这个插件的配置中修改如下所示，将ctags.exe这个文件的路径复制粘贴到设置里面的这个空里面。
在这里插入图片描述

可以通过在vscode的终端中输入ctags --version检查ctags是否完成配置。

在这里插入图片描述

如果最后你看到了如图那样的将鼠标放在一个变量旁边就会自动弹出一个小遮挡显示这个变量的信息，那就说明你的ctags安装成功了。你可以试着点击鼠标右键-快速查看-速览定义来看一下这个变量的细节。

2022年11月2日更新

注意到有评论反馈下载了ctags插件并按照说明配置之后无法hover显示变量定义的问题。针对此问题，可能的解决办法为：打开当前工作区的.vscode\setting.json文件，检查"verilog.ctags.path"是否符合配置说明中的路径。注意到有时复制路径会出现如下图所示的错误，请删除最前端的[U+202A]字符。关于该字符的出现可以参考该资料(惊！\u202a错误，百分之九十都不知道的隐藏在文件路径里的惊天秘密！（干货收藏）)
在这里插入图片描述