杭电计算机组成原理课程设计-ISE_IP核生成教程

最新推荐文章于 2022-11-11 20:24:32 发布
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分类专栏： 杭电计算机组成原理课程设计
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  在计算机组成原理课程设计中，我们需要创建Memory IP核，此处以FPGA自带的存储器IP核来实现
以下为使用ISE创建IP核的方法

1.创建.coe文件

在这里插入图片描述
如图所示，创建一个txt文件
memory_initialization_radix 规定了存储数的进制，此处为16进制
memory_initialization_vector 后的即为存储数，中间用英文逗号隔开
保存后将文件后缀改为.coe

2.如图所示，在ISE中新建IP核

在这里插入图片描述
在这里插入图片描述
输入IP核名称后点击next
在这里插入图片描述
选择如图所示选项，选择next后在新弹出页面选择finish
后可见下图所示界面
在这里插入图片描述
点击next
在这里插入图片描述
选择single port RAM后next
在这里插入图片描述
因为我们需要的存储器由32个64位寄存器组成，故修改图中数值，后选择next

在这里插入图片描述
勾选load init file，browse选择之前创建的,coe文件，导入正确的话选择show可显示
在这里插入图片描述
导入成功后选择generate选项即可

3.IP核的调用

在这里插入图片描述
如图所示复制相应代码即可调用IP核模块

IP核内容更新

想要更新IP核存储器中的内容，只需修改相应.coe文件，后按如图所示选项双击执行即可
在这里插入图片描述

平平无奇马中伞
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