可劲ル造-CSDN博客

原创《Sigrity SystemSI 2023+LPDDR4仿真自学笔记》（一）创建工程（Part2）

Block3/4——Memory1 2 可以载入存储器的IBIS模型，本例选择LPDDR4的IBIS模型载入。本例按需求，放入Layout代替PCB，Layout这个Block具有设置PCB参数，并且提取S参数的功能。Block1——Controller 可以载入IBIS模型，本例选择SOC的IBIS模型载入。另外再把SOC的DIE TO PIN的S参数放入拓扑图中，绘制完成的拓扑系统如下图。Block2——PCB 可以载入.ckt文件，或.sp文件等，不能进行S参数提取。

2024-06-03 21:34:40 189

原创《Sigrity SystemSI 2023+LPDDR4仿真自学笔记》（一）创建工程（Part1）

为了加强SystemSI 2023软件的熟悉度，咱们完整的走一个仿真全流程。

2024-05-31 10:09:54 865

原创《Sigrity SystemSI 2023+LPDDR4仿真自学笔记》（十一）时序预算设置Set Timing Budget (Part 1)

↑ Tips：填写依据来源—LPDDR4的实际工作速率，例如实际项目中最高是3200Mbps，那么咱们填写3.2Gbps。点击Workflow中的“Set Timing Budget”，会弹出“Timing Budget”的界面，用来设置仿真时的时序相关的参数。↑ Tips：此处灰色，不可编辑。Q1：具体为何要设置为双边沿，还是上升边沿，下降边沿，此处还要再细究，待补充。●Default Strobe Offset ：默认选通偏移量，单位ns↓。●Bit Period ：比特位周期，用UI表示，单位ns。

2024-04-27 10:59:49 499

原创《Sigrity SystemSI 2023+LPDDR4仿真自学笔记》（十）仿真报告的生成Report Generator （part 2）

Tips：这两个和Threshold选的技术规范有关系，选择LPDDR3(AC150/DC100)等，此处会出现默认的模板。当勾选Timing时，后面的浏览符号可以点击，选择.csv格式的文件载入。Tips：勾选后，下方的Trigger Period和Eye Aperture会由灰色激活可选。Tips：勾选后，DQ/CA Mask会变为灰色不可勾选。Tips：默认没勾选，若勾选后，报告中会有“Worst Case Summary”。Tips：这里的意思是，选择Eye Aperture的显示形状。

2024-04-13 16:23:40 634

原创《Sigrity SystemSI 2023+LPDDR4仿真自学笔记》（九）仿真报告的生成Report Generator （part 1）

神奇的是，它就一直保持在701，我重新选择其它的DDR规范，数值会变化，然后再次选择这个“LPDDR4-3200”，仍然自动弹出“701”，这里要注意，有坑。按我们正在仿真的DDR的版本去选择技术规范，例如选择“LPDDR4-3200”后，右侧的“AC Threshold（mV）”和“DC Threshold（mV）”会自动弹出两个电压数值。Tips：我是在拓扑图中把“Ctrl端”和“Mem端”的“Pin RLC”勾选上，此时这里才有Pkg Pin的选项，如果不勾选不知道是否会有“Pkg Pin”选项。

2024-04-13 11:30:19 1120

原创《高速电路设计与仿真自学笔记》（七）传输线之真实的PCB有损耗铜皮

前情提要：上一篇简述了无损耗传输线相关的定义。前文链接在实际的PCB中，走线并不是理想的表面光滑的矩形截面导体。走线通常是由铜皮蚀刻出来，，粗糙的表面了的电流，相应的也会使。当速率＞GHz以上时，趋肤深度非常薄，可以比拟导体表面上粗糙颗粒的大小，这个情况下的趋肤效应是如何分析呢？

2024-03-05 11:05:36 382

原创《高速电路设计与仿真自学笔记》（七）有损耗传输线

前情提要：上一篇简述了无损耗传输线相关的定义。前文链接。

2024-03-05 08:48:36 382

原创《高速电路设计与仿真自学笔记》（六）无损耗传输线模型

前情提要：上一篇简述了传输线相关的定义。前文链接。

2024-02-26 11:51:16 779 1

原创《高速电路设计与仿真自学笔记》（五）传输线的定义

传输线（Transmission Line）是指用来把能量（电磁波能量和信息）从一端传送到另一端的导体结构。当信号互连的电路尺寸接近信号中设计者所关心的最高频率的波长时，互连线上不同位置的电压或电流的大小与相位均可能不相同，传输线效应就会变得显著，此时需要考虑传输线的特性，需要用到。

2024-02-22 11:12:12 979 1

原创《高速电路设计与仿真自学笔记》（四）信号质量之传输延迟、上升下降时间、偏移、有效电平时间、抖动

前情提要：上一篇简述了信号质量过冲、回冲、振铃、边沿非单调。前文链接。

2024-02-19 17:13:14 1321 1

原创《高速电路设计与仿真自学笔记》（三）信号质量之过冲、回冲、振铃、单调性

信号完整性需要保证信号传输过程中的质量。信号质量就是设计者必须保证信号在驱动端、互连结构上，特别是接收端上的特性，避免造成功能性和稳定性方面的问题。信号质量一般包括过冲、回冲、振铃、边沿单调性等方面的问题，如图1-1所示。图1-1 数字信号波形质量2、理解部分信号质量术语①过冲(Overshoot)是信号高于信号供电电源电压Vcc的最高电压。是信号低于参考地电压Vss的最低电压。如图1-2所示。图1-2 过冲示意图通常过冲是由于信号传输路径的阻抗不连续所引起的反射造成的。

2024-02-19 11:52:46 1645 1

原创《高速电路设计与仿真自学笔记》（二）时域与频域

看过不少信号完整性的书籍，基本都逃不过时域和频域的概念理解，所以花点小时间进行一次概念梳理。●时域是信号处理中一个非常常用的概念，它表示信号随时间变化的特性。时域是真实世界，是唯一实际存在的域。时钟波形的X轴就是从时间角度测得的波形，如图1-1所示。图1-1 时钟波形●频域是信号处理中一个非常重要的概念，它通过将信号从时域转换到频域，使我们能够更好地理解和分析信号的特性。频域不是真实的，仅仅是更好的用于做信号分析的一种数学方法。时域的数字信号可以通过傅里叶变换转变为一个个频率点的正弦波的集合。

2024-02-05 14:40:48 956

原创《基于高速PCB开发的仿真全流程》（一）准备阶段

本文章基于模拟项目开发的流程，假设当前接收到一个高速PCB开发的任务，我们如何开展PCB设计与仿真分析。以下案例是采用软件Cadence 2023和Sigrity 2023版本。

2024-02-04 15:56:55 559 1

原创《高速电路设计与仿真自学笔记》（一）SI概念

按照高标准、高质量的风格记录，尽量让读者看得懂、有兴趣、看得下去。，（由于互连路径上不同位置的电压或电流的大小与相位均可能不同），此时的电路等效于多阶电路元件，被称为分布式元件。包括电压、电流在互连结构中产生的噪声、干扰及由其造成的时序影响等。在涉及到高速数字电路、集成电路、总线架构、通信系统、高频电路等领域的设计和分析。●现实世界里的数字信号并不只是0或1的表现，一定会存在从0到1或从1到0的。完整性中的互连模型都是基于集总元件和分布元件来加以描述。，此时的电路等效于一阶电路元件，被称为集总元件。

2024-02-04 14:58:18 477 1

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