实验五、计数器逻辑功能和设计

最新推荐文章于 2025-04-21 10:38:33 发布

ヰ緒

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分类专栏：数字电路基础实验报告文章标签：其他

本文链接：https://blog.csdn.net/weixin_48592055/article/details/123907645

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6.实验内容及步骤

（1）测试74HC161的逻辑功能，根据测试结果总结并描述其逻辑功能，表格自行完善。

表2.5.1 74HC161的功能表

（2）测试74HC390的逻辑功能，根据测试结果总结并描述其逻辑功能，表格自行完善。

表2.5.2 74HC390功能表

（3）用74LS161和74LS390构成N进制计数器（利用数码管显示）

输出端				数码管对应的字符
QD	QC	QB	QA	数码管对应的字符
0	0	0	0	0
0	0	0	1	1
0	0	1	0	2

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它具有同步预置、异步清零功能，支持并行数据加载，并可在计数使能控制下进行二进制计数。：低电平时，在下一个时钟上升沿加载输入数据（A, B, C, D）。（多个 74LS161D 串联构成 8 位、12 位等更长计数器）。低电平时，下一个时钟上升沿加载输入数据（A, B, C, D）。：低电平有效，立即清零计数器（不受时钟控制）。均为高电平时，每个时钟上升沿计数。：两者均为高电平时，计数器才能递增。：立即清零计数器（不受时钟控制）。（通过预置初始值控制计数范围）。（计数范围：0 ~ 15，即。

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而从功能表的第四行又知道，当CR＝LD＝1时，只要CTr和ENP中有一个为0，则不管CP状态如何（包括上升沿），计数器所有数据输出都保持原状态不变。从功能表的第二行可知，当CR＝1且LD＝0时，时钟脉冲CP上升沿到达，四个数据输出端QA、QB、QC、QD同时分别接收并行数据输入信号a、b、c、d。另外，进位输出QCC=CTr·Q0·Q1·Q2·Q3表明，进位输出端仅当计数控制端CTr＝1且计数器状态为15时它才为1，否则为0。74LS161为二进制同步计数器，具有同步预置数、异步清零以及保持等功能。

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