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RSS订阅原创 PT 实操
分别记录的是data的传输路径和时钟信息的传输路径 以中间空行为分割，分别记录了传输路径中经过的cell名字和cell的类型，cap这一列记录了cell对应的capacitance，Delata列记录了crosstalk的影响，Incr列记录了上一行到本行的增量，path是指到本行为止积累的延迟。接下来是last common pin 是最近的common 的pin节点，用于寻找这条时序线的commonpath，launch path，capture path。3.-group (指定组别类型）
2024-06-12 15:57:21
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原创 项目实操：add Physical only cell
项目进行到ECO阶段，需要一个block添加physical only cell。cell类型是OCOVL。全称On Chip Overlay Cell，是用于规模较大的芯片设计中，检查工艺PO和OD以及CO和PO的mask之间的重叠关系，可以减少mask对准上的错误，提升良率。一般是在floorplan阶段进行摆放规划，pitch范围一般大于2mm。所以在实际操作中需要把OVL添加到距离左右上下2500um的位置，因此需要移动原本放置在该位置的OCCD cell。
2024-06-04 16:54:54
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原创 innovus PPPR阶段
Power Plan Power Routing 目的是给芯片设计一个均匀的供电网络，芯片供电是通过I /O 单元来实现的，在做电源规划和电源网络设计时，首先要做电源预算（power budgeting），商用产品惯例认为总的误差应当控制在5%之内。它包括从电源网络和PCB板级到封装bonding之间的波动（约为1%)，再到电源I /O 单元和电源环之间的波动(约为1%)和最终直至标准单元之间的电压降(约为3% )。更准确的预算则通过功耗分析的手段来做定量计算。
2024-05-16 18:18:50
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原创 GVIM 工具指南
Gvim的设置分两种：1. 临时设置，2. 默认设置。配置Gvim只需修改Gvim配置文件即可，在Linux中，配置文件的地址是~/.vimrc，若没有该文件直接创建即可，我们可以直接输入`gvim ~/.vimrc来进行配置。
2024-05-16 10:53:55
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1原创 数字后端基础知识：EM
EM现象深刻影响着芯片寿命，因为芯片只要在使用，就会发生EM现象，使用的越久，EM所累积的效应就越多，金属变形会越来越严重。理论上来说芯片的寿命是有限的，只要工作的够久，EM总会使芯片失效。如何来量化EM的影响呢？EM 全称 electromigration（电迁移）它指的是：在通电导体中，由于电子的定向移动移动，会与金属线中的金属原子产生碰撞，导致金属原子移位，宏观上表现为金属线发热，变形，熔断，对于芯片中纳米级很细的导线来说，久而久之可能会使net发生短路或断路，进而造成芯片工作失效。
2024-05-13 10:45:10
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原创 数字后端基础知识：IR
如果芯片中的IR drop过大，则stdcel就有功能障碍. 具体来说是怎么导致gate延迟增加的呢，可以理解为电压减少，电流减少，对器件的充放电变慢，开关速度变慢，同时skew也变大，还会引起时序违例问题。decap cell (电源的Power和Ground之间接入一个适当大小的capacitor，利用capacitor的通交流阻直流的特性，可以平缓电源电压的波动),decap Cell的内部实现很显然就是一个连接Power和Ground的capacitor;本质上还是减少电流，别让电压降的太厉害。
2024-05-13 01:19:17
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空空如也
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