2017全国电赛综合测评四分频电路(一片D触发器74LS74的两种方法,有图有真相,实测波形图)

在"2017 年全国大学生电子设计竞赛综合测评题"的《复合信号发生器》中出现的要求使用1片HD74LS74搭建四分频电路,以下是两种解决方案:

 

使用2个D触发器(1片74LS74芯片)可以用两种方法接成四分频电路

方法一:先接成两个二分频电路,再相连就是四分频电路,依次类推可以做成八分频、十六分频...........

方法二:直接四分频电路

 

结论:这两种方式都可以实现四分频,但是它们的高电平都是有一些畸变的,畸变的原因是IO口的翻转速度衔接有误差被各种高频杂波耦合进去了,我尝试过多种方法无法直接消除(如果你能只用电阻电容消除这个畸变请在评论区告诉我),如果确实要让波形变得很方正好看的话需要在最后输出端接一个斯密特触发器对波形整形。

如下图:

我输入频率为20KHz的方波,用上述两种方法四分频得到5KHz的方波,

黄色是方法一,蓝色是方法二(波形畸变不一样)

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根据引用\[2\]中的描述,使用JK触发器和堆叠触发器可以实现2的幂数的分频器。对于分频电路,我们可以使用两个JK触发器来实现。 首先,我们需要将两个JK触发器连接在一起,形成一个堆叠触发器。其中,第一个JK触发器的时钟输入为原始信号源,第二个JK触发器的时钟输入为第一个JK触发器的输出。这样,第一个JK触发器的输出将作为低位,第二个JK触发器的输出将作为高位。 接下来,我们需要设置JK触发器的输入,以实现分频。对于JK触发器,当J和K都为0时,保持原来的状态;当J为1,K为0时,输出为1;当J为0,K为1时,输出为0;当J和K都为1时,输出取反。因此,我们可以将第一个JK触发器的J和K分别连接到高电平和低电平,将第二个JK触发器的J和K分别连接到第一个JK触发器的输出和低电平。 这样,我们就可以得到一个分频电路,输出频率为输入频率的分之一。 #### 引用[.reference_title] - *1* *2* [【数电】如何使用74LS112(或74LS74)构成一个十分频器(模七计数器)](https://blog.csdn.net/u013926582/article/details/25014787)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^control_2,239^v3^insert_chatgpt"}} ] [.reference_item] - *3* [用verilog 实现 74LS160,然后实现2000分频占空比50的分频器](https://blog.csdn.net/koala_cola/article/details/106479816)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^control_2,239^v3^insert_chatgpt"}} ] [.reference_item] [ .reference_list ]

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