ModelSim中编译synplify库

已于 2023-08-19 15:11:31 修改
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分类专栏： 综合 文章标签： fpga开发
于 2022-08-25 22:12:00 首次发布
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本文链接：https://blog.csdn.net/wwwwws/article/details/126533562
版权
  1. 退出仿真：quit -sim
  2. 切换目录：cd Y:/Program/LiberoSoCv11/SynplifyPro/lib/vhdl_sim/
  3. 建立新库：vlib synplify
  4. 映射路径：vmap synplify Y:/Program/LiberoSoCv11/SynplifyPro/lib/vhdl_sim/synplify
  5. 编译文件：vcom -2008 -explicit  -work synplify "synplify.vhd"
  6. 编译文件：vcom -2008 -explicit  -work synplify "../vhdl/synattr.vhd"
  7. 开始仿真：vsim ... -L synplify -lib work work.tb_....
  8. 代码头部：library synplify;use synplify.attributes.all;
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