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TI
文章平均质量分 63
zixiang_w
这个作者很懒,什么都没留下…
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PRU pruss, rproc_pru和prueth uboot源码分析
首先看一下PRU_ICSSG的功能框图,对于AM64来说,包含两个PRU_ICSSG模块。每个PRU_ICSSG共包含两个slice。每个PRU core自己Local Instruction RAM, 容量不同。PRU 内核执行任何指令之前,需要由外部 PRU_ICSSG 主机处理器对其进行初始化。关于IRAM跟详细的信息,可以参考TRM除了IRAM外,还有DRAM, 需要注意的是,从 PRU0 能直接访问数据 DRAM 1 以及 PRU1 能直接访问数据 DRAM 0, Shared RAM。原创 2024-01-16 16:25:56 · 897 阅读 · 0 评论 -
Memory Map
主要介绍AM64x的MSRAM和DDR的内存分布:MSRAM:总共2MB,被分成8个banks,每个256KB。首先了解一下,两种Domain:微控制器单元域(MCU域)是一个“chip-in-a-chip”的概念,它使用操作。这使得MCU域可以,而,包括设备其余部分处于复位或下电状态的时间。MCU Island集成了通信外设,如SPI, I2C和UART,这些外设预计用于安全关键通信,因此如果主SoC出现故障,MCU Island可以将此信息通信到系统的其余部分。原创 2023-04-07 10:34:43 · 490 阅读 · 0 评论 -
Sitara™处理器的产品开发路线图
一般情况下,会存在四个主要的发展阶段,其中TI EVM为我们提供了良好的软硬件基础,可以在不同的阶段进行参考和验证。原创 2023-02-15 21:38:43 · 362 阅读 · 0 评论 -
CSS使用过程中遇到的问题
问题记录原创 2023-01-21 08:27:21 · 112 阅读 · 0 评论 -
IPC for AM64x
AM64x处理器有两个双核Cortex-R5F子系统(R5FSS)和一个Cortex-M4F子系统,此外还有一个双核Cortex-A53子系统。正常情况下,引导加载程序(U-Boot/SPL)引导A53并使用HLOS(Linux/Android)加载。然后A53引导R5和M4F核心。本文适用于在Cortex A53内核上运行Linux的AM64x用户。目标是帮助用户了解如何与R5F和M4F核心建立通信。这个任务有很多方面:构建、加载、调试、内存共享等。本文打算采取循序渐进的步骤来理解所有这些部分。原创 2022-12-01 20:58:58 · 580 阅读 · 0 评论 -
System Firmware
系统固件是一个集合术语,用于描述TI基础安全(TIFS)和资源管理(RM)/电源管理(PM)服务。系统固件在AM64x上的安全管理器和设备管理器核心(DMSC)上执行。原创 2022-11-29 12:38:17 · 1713 阅读 · 0 评论 -
Kernel Performance
preformance原创 2022-11-27 19:36:09 · 90 阅读 · 0 评论 -
GP to HS-FS Migration Guide(TI AM64 GP EVM)
GP to HS-FS Migration Guide(TI AM64 GP EVM)原创 2022-11-26 20:50:27 · 141 阅读 · 0 评论 -
Build U-Boot(基于TI AM64)
Build U-Boot(基于TI AM64)原创 2022-11-26 17:12:08 · 1162 阅读 · 1 评论 -
DDRSS ECC(含bw_mem test ,ecc_enable and ecc_disable)
DDR subsystem(DDRSS)是由DDR controller、DDR PHY 和wrapper logic构成。为了保证SDRAM数据的完整性,DDRSS桥支持对写入或从SDRAM读取的数据进行内联ECC。ECC对所有在ECC保护地址范围内的访问进行计算。1位错误可通过ECC纠正,2位错误不可纠正,将被软件视为不可恢复错误并触发异常。原创 2022-11-25 21:29:15 · 706 阅读 · 0 评论 -
Texas Instruments 处理器资料导航(TI AM64x)
导航资料原创 2022-11-22 20:19:38 · 853 阅读 · 0 评论 -
ARM启动过程中的spl
spl是一个十分小的bin文件,主要用来引导主u-boot。原创 2022-11-21 19:28:07 · 482 阅读 · 0 评论