quartus仿真24：数据选择器MUX四选一74153八选一74151

最新推荐文章于 2024-04-29 17:58:32 发布
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分类专栏： 数电
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本文链接：https://blog.csdn.net/xiong_xin/article/details/109131139
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  • 数据选择器又称多路选择器（Multiplexer，MUX）常见数据选择器有2选1、4选1和8选1数据选择器。数据选择器功能可类比于一个单刀多掷的开关。
  • 2选1选择器是在A的控制下从D1D0选择一路送到Y。A=0时将D0上的数值送给Y，A=1时将D1上的数值送给Y。
    在这里插入图片描述
  • 用8选1的MUX实现逻辑函数
    • 8选1MUX的型号为74151，对将函数写成最小项形式并分配系数m0和m6接低其余接高。

在这里插入图片描述

  • 8选1实现两个输入变量的函数
    在这里插入图片描述
  • 逻辑变量数大于地址位数
    在这里插入图片描述
  • 数据选择器进行扩展，用4选1MUX实现8选1MUX
    • 利用使能端
    • 树状扩展
    • 需要指出的是C接口时MSB，A接口是LSB
    • 同时放个74151作为对照，出错点：将两个输入端接到一起，修改为用或门接在一起
    • 设置D端输入为0101_1110，可以看出当A2A1A0=111时输出0（最后一个数），串行输出为01111010，D0-D7的顺序来读
      在这里插入图片描述
  • 用4选1MUX实现16选1MUX（树状扩展）
  • 高两位A3A2选择Y4Y3Y2Y1哪一路传输，低两位A1A0共接控制4选1MUX准备一路数据放在输出Y口
  • 准备数据D[15…0]=1010_1100_1110_0001，按照D0先输出的顺序为1000_0111_0011_0101

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只是有点小怂
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verilog入门——Quartus二选一数据选择器实现及测试
m0_56611833的博客
04-02 4086
创建工程 添加verilog文件 编写源文件、TestBench测试文件并保存 修改设置 注意file name的名字必须和testbench中module名称相同，否则会load error *检查配置 综合 查看波形 文本形式仿真结果 波形图形式仿真结果 ...
两个四选一数据选择器组成八选一_测量知新 | 平面度测量：方法、数据采样与分析案例...
weixin_39610415的博客
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在上期的测量知新专栏中，我们探讨了平面度的定义、计算方法和四项主要的指标。本期测量知新专栏我们将延续上期的话题，从操作层面进一步讲解平面度的测量和数据采样方法，并利用一个小案例来解析最终的分析步骤。1.测量方法平面度是一项非常重要的产品几何规范参数。早在1830年，十九世纪最优秀的机械工程师和发明家——约瑟夫·惠特沃斯利用三平面法制作出非常精密的标准平面。三平面法是利用三块平面板互相研磨，用钢制的...
quartus18.0编译仿真的四选一数据选择器
03-31
利用quartus18.0软件编译仿真的四选一数据选择器，含测试文件，供学习电子设计自动化（eda）的新人参考
四选一选择器 MUX.v
04-18
四选一选择器代码分享
计组课设实验（1）数据选择器的quartusII工程
04-09
具体描述见：https://blog.csdn.net/weixin_46841376/article/details/115368646
使用Quartus创建一个Verilog语言实现的四位四选一复用器
最新发布
s2323748558的博客
04-29 359
置顶之后切回Hierarchy，如果原本的项目名称变成了刚刚被置顶的程序就说明刚才已经成功了，运行之后需要等一会，左下角的框是运行状态，全部打钩或者全部到100%就表示运行成功了。选next，上面的路径是项目的路径，下面是项目名，根据自己的要求修改，继续next。首先进入Quartus，点击左上角的file（文件），选new新建一个文件。保存时会提示是否将文件放在一个新创建的项目里，选YES，弹出窗口。此时会新建一个窗口，在新建的窗口中编写代码，写完之后保存。在file页面中找到我们需要编译运行的程序。
4选一数据选择器Verilog代码Quartus仿真
xiakunpei123的博客
12-28 2324
代码功能：4选一数据选择器
Quartus Prime设计4选1数据选择器
m0_70145753的博客
05-28 2464
从而实现4选1数据选择器。
Quartus II使用说明（Verilog HDL二选一数据选择器 ）
菜鸟打怪的博客
04-02 8491
《可编程数字逻辑电路设计》课程中Quartus II软件的使用说明 1.新建文件夹，里面包含5个子文件夹（doc/img/prj/rtl/testbench） 2.打开Quartus II软件 ，创建新工程。 3. 选择工程目录为步骤1新建的文件夹的路径；为这个工程起个名字(sel)。 4.设置为Cyclone IV E，引脚数256，速度8，选择设备为EP4CE10F... 5.仿真环境：Verilog HDL 6.完成。Finish! 7.文件-新建-Verilog HDL...
EDA实验----四选一多路选择器设计(QuartusII)
m0_73633088的博客
11-11 1万+
这里我们会看到，下面有一个芯片，这个也就是我们写好了的sof文件，然后就是通过你的电脑接口去连接到开发板，如果你看到上面有一个No Hardware的时候，你点击旁边的按钮进行接口设置，设置为USB接口即可。然后就是点开block文件，然后点击选择元器件，点开project文件夹，这里我们就会看到，有一个生成的元器件，也就是我们前面Verilog语言编程的元器件。（根据实际情况需求去绑定）如图所示，点击此处编译运行。然后，把这个文件设置为顶层文件，右键点击这个.v文件，然后如下图所示，点击设置顶层文件。
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在Quartus 上实现一个二选一数据选择器，希望有帮助
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Verilog VDL编写的四选一数据选择器报告，第一次使用Quartus 2，步骤详细，里面有附源代码。
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05-04
以下是使用 Quartus 18.1 实现的 4:1 数据选择器的 Verilog 代码，以及仿真波形： ```verilog module mux4to1(input [3:0] data_in, input [1:0] sel, output reg out); always @ (sel or data_in) begin case...
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在这个“二选一数据选择器VHDL”项目中，我们可以看到一个简单的实验工程，它包含了实现一个二选一数据选择器的VHDL代码和其他相关文件。 二选一数据选择器（MUX 2:1）是一个基本的数字逻辑组件，它有两个输入（A和...
电子入门基础知识之：多路选择开关(MUX)
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