M.2 PERST#信号上下拉问题

最新推荐文章于 2024-08-15 20:57:31 发布

Nicholas Tekken

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文章标签：硬件工程

本文链接：https://blog.csdn.net/zxcvbnm_007sss/article/details/126760603

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本文探讨了M.2 PCIe接口中的PERST#信号控制，该信号在系统复位时由CPLD拉低。预留下拉10k电阻到地的主要目的是确保在没有CPLD控制时，信号保持稳定状态，防止信号线上的噪声引起意外的设备复位。理解这一机制对于嵌入式系统的设计和故障排查至关重要。

摘要由CSDN通过智能技术生成

M.2 PERST#信号上下拉问题

M.2 pcie rst信号，接到CPLD，由cpld进行控制，PERST#低有效，正常都是高3.3V/1.8V，系统复位时内部程序操作将其拉低。
这里预留下拉10k电阻到地的目的是什么呢？
M.2 PERST#预留下拉问题

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