第六届国际电子通信大会(IECC 2024)即将召开!

2024年第六届国际电子通信大会(IECC 2024)将于7月19-21日在日本福冈九州大学举办。IECC系列会议自2019年首次在日本冲绳召开以来,已经连续五年成功召开。本次会议将面向全球对电子通信领域感兴趣的学术界、工业界和研发组织的研究人员,他们将齐聚共同研讨目前电子通信领域高质量发展下,所面临的现实挑战和突破路径。

IECC 2024 | Fukuoka, Japanicon-default.png?t=N7T8https://iecc.net/

组织单位:

征稿主题:

通讯技术:

数字通信技术

卫星通信技术

无线网络通信技术

移动通讯

移动自组织网络……

电子产品:

数字电子产品

电力和应用电子产品

电子技术

纳米电子学和微电子学

半导体技术

电力电子和驱动系统……

更多主题,详见:

http://www.iecc.net/call%20for%20papers.html

会议出版及检索:

被接收的文章会被发表在ACM国际论文集上(ISBN: 979-8-4007-1759-8),并被Ei Compendex和Scopus双检索。

出版历史:

IECC 2019, 2020, 2021, 2022 & 2023论文集都在会后三个月左右被Ei Compendex 和Scopus检索。

会议历史:

会议投稿:

系统投稿:https://www.zmeeting.org/submission/IECC2024

邮箱投稿:iecc.conference@gmail.com

会议组委会:

会议主席:

Prof. Isao Echizen来自日本国立信息研究所

Prof. Qun Jin来自日本早稻田大学

Prof. Chin-Chen Chang来自逢甲大学

项目共同主席:

Prof. Maode Ma来自卡塔尔大学

Prof. Hisato Kobayashi来自日本法政大学

Prof. Liang-Bi Chen来自台湾国立澎湖科技大学

Prof. Hiep Xuan Huynh来自越南芹苴大学

指导联合主席:

Prof. Chuah Joon Huang来自马来西亚马来亚大学

Prof. Rohaya Latip来自马来西亚博特拉大学

Prof. Bernd Wolfinger来自德国汉堡大学

主旨报告嘉宾:

Isao Echizen教授,日本国立情报学研究所

马茂德教授,卡塔尔大学

特邀报告嘉宾:

Hisato KOBAYASHI名誉教授,日本法政大学

F. John Dian教授,加拿大温哥华不列颠哥伦比亚理工学院

联系方式:

会议专员:姚女士

微信:15262690314


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### DDR ECC 技术概述 在外置错误校正码 (OECC, Off-chip Error Correction Code) 和内置错误校正码 (IECC, In-Chip Error Correction Code) 方面,两者都旨在提高数据传输的可靠性。然而,在实现方式和技术细节上存在显著差异。 #### 外置错误校正码 (OECC) 外置错误校正码是指位于存储芯片外部的纠错机制。这种类型的ECC通常由内存控制器负责处理。当数据写入DRAM时,内存控制器会计算并附加额外的冗余位到实际的数据流中[^1]。这些冗余位用于检测和纠正可能发生的单比特错误,并能识别双比特错误的存在而不进行修复。 对于读取操作而言,同样的过程会在接收端重复执行——即先验证是否存在错误再决定如何响应。如果发现可修正的错误,则自动更正;若是不可恢复的情况则报告给更高层软件或硬件逻辑来采取进一步措施。 ```python def apply_oecc(data_bits): ecc_bits = calculate_ecc(data_bits) encoded_data = data_bits + ecc_bits return encoded_data ``` #### 内置错误校正码 (IECC) 相比之下,内置错误校正码是在每个单独的DRAM单元内部集成了一定程度上的自我保护能力。这意味着部分现代DDR SDRAM设备能够在不依赖于外界帮助的情况下自行完成某些级别的错误探测改正工作。具体来说,这类功能往往通过增加少量辅助电路以及相应的算法支持得以实现,从而允许每一个独立模块具备基本的安全保障特性。 ```c++ class DRAMModule { public: void writeDataWithIECC(uint8_t* data); private: uint8_t computeInternalECC(const uint8_t* rawData); }; ``` #### 主要区别 - **位置不同**: OECC是由系统级组件如CPU或其他专用集成电路(ASICs)管理,而IECC则是嵌入到了具体的物理存储介质之中; - **性能影响**: 使用IECC可能会带来更低延迟的优势因为不需要跨多个器件传递信息来进行编码解码流程; - **复杂度对比**: 实现复杂的多级别检错修正是相对容易在较大规模架构下做到的事情(比如整个系统的层面),但对于单一DIMM条目内来讲就显得更加具有挑战性了。
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